參數(shù)資料
型號(hào): ZI050
英文描述: 模擬鎖相環(huán)芯片
中文描述: 模擬鎖相環(huán)芯片
文件頁(yè)數(shù): 8/17頁(yè)
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代理商: ZI050
模擬鎖相環(huán)用戶手冊(cè)
(V1.0)
CLKIN(Pin9)
DATAIN(Pin7)
RCLK(Pin11)
RDATA(Pin12)
Phase
Alignment
Data 1
Data 1
1.5 Cycles
4
鎖定輸出時(shí)序
RCLK的下降沿對(duì)準(zhǔn)再生的NRZ數(shù)據(jù)RDATA的1/2處
4
所示輸入數(shù)據(jù)DATAIN的數(shù)據(jù)傳輸密度為
100%
即為1010的數(shù)據(jù)流
通常
數(shù)據(jù)流的密度小于100%
在實(shí)際應(yīng)用中輸入時(shí)鐘或數(shù)據(jù)信號(hào)DATAIN頻率可能很低(<200kHz), 由于鑒相器有限的低通特性
時(shí)鐘信息可能直接通過鑒相器
此時(shí)
需要在環(huán)路濾波器中加入額外的元件
以在環(huán)路濾波器中增加
一個(gè)極點(diǎn)來(lái)削弱進(jìn)入到VCXO輸入端VC的交流信號(hào) 如圖
12
所示 詳細(xì)信息可以向我們的工程師咨詢
2.3
鑒相器增益
圖6所示為鑒相功能的簡(jiǎn)化電路圖 其中包括減小輸入數(shù)據(jù)DATAIN占空比影響的電路 通常 Zi050
電路對(duì)占空比和占空比的變化不敏感
鑒相器輸出一個(gè)與DATAIN (Pin 7)和CLKIN (Pin 9)的相差成
比例的直流電平
VD
VD與DATAIN (Pin 7)和CLKIN (Pin 9)的相差的關(guān)系如圖
5
所示
Vd
Vd/2
Relative
Phase(
e)
Gain Slope = 5V/2
5
鑒相器增益
6
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PDF描述
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