參數(shù)資料
型號(hào)： XRT91L80IB-F
廠商： Exar Corporation
文件頁數(shù)： 24/46頁
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描述： IC TXRX SONET/SDH 4BIT 196STBGA
產(chǎn)品變化通告： XRT91L80IB Obsolescence 6/Sept/2010
標(biāo)準(zhǔn)包裝： 126
類型： 收發(fā)器
規(guī)程： SONET/SDH
電源電壓： 3.3V
安裝類型： 表面貼裝
封裝/外殼： 196-LFBGA
供應(yīng)商設(shè)備封裝： 196-STBGA（12x12）
包裝： 托盤
XRT91L80
xr
2.488/2.666 GBPS STS-48/STM-16 SONET/SDH TRANSCEIVER
REV. 1.0.0
22
The on-chip phase/frequency detector can also be used to remove the jitter from a noisy reference signal that
is applied to the REFCLKP/N inputs. In this case, the LOOPTM_NOJA pin should be set "Low", the
VCXO_SEL set "High", and the LOOPTM_JA pin set "Low". In this configuration, the REFCLKP/N signal is
used as the reference to the de-jitter PLL and the de-jittered output of the phase locked VCXO is used as the
timing reference to the CMU. Table 9 provides configuration for selecting the loop timing and reference de-jitter
modes.
TABLE 9: LOOP TIMING AND REFERENCE DE-JITTER CONFIGURATIONS
VCXO_SEL
LOOPTM_JA
LOOPTM_NOJA
ACTION
0
Normal mode
0
1
Loop timing without de-jitter VCXO
1
0
REFCLKP/N reference de-jitter VCXO
1
0
Loop timing with de-jitter VCXO
FIGURE 13. LOOP TIMING MODE USING AN EXTERNAL CLEANUP VCXO
VCXO_LOCK
LOOPTM_JA
RXIP
RXIN
Phase
Detect
CDR
M
U
X
Loop Filter
Div by 16
or 32
Clk
Data
~
VCXO
XRT91L80
CPOUT
2.488/2.666GHz
Retimer
LOOPTM_NOJA
LOCKDET_CMU
VCXO_SEL
Charge
Pump
M
U
X
1
0
1
0
PISO
M
U
X
0
1
2.488/2.666GHz
CMU
TXOP
TXON
VCXO_INP
VCXO_INN
REFCLKP
REFCLKN
ALTFREQSEL
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PDF描述
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XRT91L82IB 功能描述:總線收發(fā)器 Transceiver RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時(shí)間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel
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