參數(shù)資料
型號(hào)： XRT83D10IW
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： SINGLE CHANNEL DS1/CEPT LINE INTERFACE UNIT
中文描述： DATACOM, PCM TRANSCEIVER, PDSO28
封裝： 0.300 INCH, SOJ-28
文件頁數(shù)： 12/18頁
文件大?。?/td> 258K
代理商： XRT83D10IW
XRT83D10
SINGLE CHANNEL DS1/CEPT LINE INTERFACE UNIT
REV. 1.0.3
xr
12
1.3
To reduce frequency jitter in the transmit clock or receive clock, a crystal-less jitter attenuator is provided. The
jitter attenuator can be selected either in the transmit or receive path or it can be disabled as shown in Table 8.
JITTER ATTENUATOR
1.3.1
A FIFO overflow Signal (FOFS = 1) is indicated if the phase jitter exceeds the tolerance of the jitter attenuator.
When FOFS is "High", jitter attenuator bandwidth is increased to track the short term jitter and no data error will
FIFO Overflow Signal (FOFS):
F
IGURE
7. ITU G.703 P
ULSE
T
EMPLATE
T
ABLE
8: J
ITTER
A
TTENUATOR
S
ELECTION
J
ITTER
A
TTENUATOR
CONNECTIVITY
M
ODE
1
M
ODE
2
Bypass (Disabled)
0
0
Transmit Path
0
1
Receive Path
1
0
Test Mode
1
1
1
1
1
1
1
1
269 ns
(244 + 25)
194 ns
(244 – 50)
244 ns
219 ns
(244 – 25)
488 ns
(244 + 244)
0%
50%
2
V = 100%
Nominal pulse
Note
– V corresponds to the nominal peak value.
2
2
相關(guān)PDF資料
PDF描述
XRT83L314 14-CHANNEL T1/E1/J1 LONG-HAUL/SHORT-HAUL LINE INTERFACE UNIT
XRT83L314IB 14-CHANNEL T1/E1/J1 LONG-HAUL/SHORT-HAUL LINE INTERFACE UNIT
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XRT83L34IV QUAD T1/E1/J1 LH/SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
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參數(shù)描述
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