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參數(shù)資料
| 型號： | XRT72L52IQTR-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 487/488頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FRAMER DS3/E3 2CH 160QFP |
| 產品變化通告： | XRT72Lx Series Obsolescence 02/May/2012 |
| 標準包裝： | 250 |
| 控制器類型： | DS3/E3 調幀器 |
| 電源電壓： | 3.3V |
| 電流 - 電源： | 100mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 160-BQFP |
| 供應商設備封裝： | 160-PQFP（28x28） |
| 包裝： | 帶卷 (TR) |
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XRT72L52
82
TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
REV. 1.0.3
2.3.4.5
Receive E3 Interrupt Status Register 1 (E3, ITU-T G.751)
Bit 4 - COFA (Change of Framing Alignment) Interrupt Status
This Reset-upon-Read bit-field will be set to "1" if the Change of Frame Alignment interrupt has occurred since
the last read of this register.
The Receive E3 Framer will generate the Change of Frame Alignment interrupt if it has detected a change in
frame alignment in the incoming E3 frames.
Bit 3 - OOF (Change in OOF Condition) Interrupt Status
This Reset Upon Read bit-field is set to "1" if the Receive DS3/E3 Framer block has detected a Change in the
Out-of-Frame (OOF) Condition, since the last time this register was read. Therefore, this bit-field will be
asserted under either of the following two conditions:
1. When the Receive DS3/E3 Framer block has detected the appropriate conditions to declare an OOF Con-
dition.
2. When the Receive DS3/E3 Framer block has transitioned from the OOF Condition (Frame Acquisition
Mode) into the In-Frame Condition (Frame Maintenance mode).
NOTE: For more information of the OOF Condition, refer to
Bit 2 - LOF (Change in LOF Condition) Interrupt Status
This Reset-upon-Read bit-field will be set to "1" if a Change in LOF Condition interrupt has occurred since the
last read of this register.
The Receive DS3/E3 Framer block will generate the Change in LOF Condition interrupt is response to either of
the following two occurrences.
1. Whenever the Receive DS3/E3 Framer block transitions from the OOF Condition state into the LOF Condi-
tion state, within the E3 Framing Acquisition/Maintenance algorithm (per Figure 123).
2. Whenever the Receive DS3/E3 Framer block transitions from the FAS Pattern Verification state to the In-
frame state, within the E3 Framing Acquisition/Maintenance algorithm (per Figure 123).
Bit 1 - LOS (Change in LOS Condition) Interrupt Status
This Reset Upon Read bit will be set to "1", if the Receive DS3/E3 Framer block has detected a Change in the
LOS Status condition, since the last time this register was read. This bit-field will be asserted under either of
the following two conditions:
1. When the Receive DS3/E3 Framer block detects the occurrence of an LOS Condition (e.g., the occurrence
of 32 consecutive spaces in the incoming E3 data stream), and
2. When the Receive DS3/E3 Framer block detects the end of an LOS Condition (e.g., when the Receive
DS3/E3 Framer block detects a string 32 bits that does not contain a string of four consecutive "0’s").
The local P can determine the current state of the LOS condition by reading bit 4 of the Rx E3 Configuration
and Status Register (Address = 0x11).
NOTE: For more information in the LOS of Signal (LOS) Alarm, refer to
RXE3 INTERRUPT STATUS REGISTER 1 (ADDRESS = 0X14)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Not Used
COFA
Interrupt
Status
OOF
Interrupt
Status
LOF
Interrupt
Status
LOS
Interrupt
Status
AIS
Interrupt
Status
RO
RUR
0
1
0
相關PDF資料 |
PDF描述 |
|---|---|
| XRT72L53IB-F | IC FRAMER DS3/E3 3CH 272PBGA |
| XRT72L54IB | IC FRAMER DS3/E3 4CH 272PBGA |
| XRT72L71IQ | IC FRAMER DS3 ATM UNI 160PQFP |
| XRT73L02MIV-F | IC LIU E3/DS3/STS-1 2CH 100TQFP |
| XRT73L03BIV-F | IC LIU E3/DS3/STS-1 3CH 120LQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT72L53ES-PCI | 功能描述:網絡控制器與處理器 IC withT73LC03A+T71D03 RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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