Rev. 1.00 CIS Mode Timing -- DC Coupled (CLAMP disabled) ADCCLK tckhw tcklw tckpd tap Pixel N-1 Pixel N tdv Pixel N+1 CIS tdv [7:0]" />
參數(shù)資料
型號(hào)： XRD98L23ACU
廠商： Exar Corporation
文件頁數(shù)： 4/32頁
文件大小： 0K
描述： IC 8B CCD/CIS SIG PROC 20SSOP
產(chǎn)品變化通告： Obsolescence Notification 15/Apr/2010
標(biāo)準(zhǔn)包裝： 66
位數(shù)： 8
通道數(shù)： 3
電壓 - 電源，模擬： 3 V ~ 3.6 V
電壓 - 電源，數(shù)字： 3 V ~ 3.6 V
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
供應(yīng)商設(shè)備封裝： 20-SSOP
包裝： 管件
XRD98L23
12
Rev. 1.00
CIS Mode Timing -- DC Coupled
(CLAMP disabled)
ADCCLK
tckhw
tcklw
tckpd
tap
Pixel N-1
Pixel N
tdv
Pixel N+1
CIS
tdv
[7:0]
N-8
N/A
N-7
N/A
N-6
N/A
N-5
N/A
DB
Figure 6. Timing Diagram for Figure 5
ADCCLK
Events
↓
ADC Sample & PGA Start Tracking next Pixel
Data Out
↑
Invalid Data Out
HI
ADC Track PGA Output
LO
ADC Hold/Convert
Table 1.
Mode 2. AC Coupled
If the CIS signal has a black reference for the video
signal, an external capacitor C
EXT is used.
When
CLAMP (clamp) pin is set high an internal switch allows
one side of the external capacitor to be set to ground.
It then is level shifted to correspond to the bottom ladder
reference voltage of the ADC (Figure 7).
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PDF描述
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XRD98L53 制造商:EXAR 制造商全稱:EXAR 功能描述:CCD Image Digitizers with CDS, PGA, and 10-bit A/D
XRD98L53AIV 制造商:EXAR 制造商全稱:EXAR 功能描述:CCD Image Digitizers with CDS, PGA, and 10-bit A/D
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