參數(shù)資料
型號(hào)： XR16C854D
廠商： Exar Corporation
英文描述： 2.97V TO 5.5V QUAD UART WITH 128-BYTE FIFO
中文描述： 2.97V至5.5V四路UART的128字節(jié)FIFO
文件頁(yè)數(shù)： 23/51頁(yè)
文件大?。?/td> 476K
代理商： XR16C854D
XR16C854
23
Rev. 1.00P
REGISTER FUNCTIONAL DESCRIPTIONS
The following table delineates the assigned bit functions for the fifteen 854 internal registers. The assigned
bit functions are more fully defined in the following paragraphs.
XR16C854 ACCESSIBLE REGISTERS
A2 A1 A0
Register
[Default]
Note *5
BIT-7
BIT-6
BIT-5
BIT-4
BIT-3
BIT-2
BIT-1
BIT-0
General Register Set
0
0
0
RHR [XX]
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
0
0
0
THR [XX]
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
0
0
1
IER [00]
0/
0/
0/
0/
modem
status
interrupt
receive
line
status
interrupt
transmit
holding
register
receive
holding
register
-CTS
interrupt
-RTS
interrupt
Xoff
Sleep
mode
interrupt
0
1
0
FCR [00]
RCVR
trigger
(MSB)
RCVR
trigger
(LSB)
0/TX
trigger
(MSB)
0/TX
trigger
(LSB)
DMA
mode
select
XMIT
FIFO
reset
RCVR
FIFO
reset
FIFO
enable
0
1
0
ISR [01]
0/
0/
0/
0/
int
int
int
int
FIFOs
enabled
FIFOs
enabled
-RTS,
-CTS
Xoff
priority
bit-2
priority
bit-1
priority
bit-0
status
0
1
1
LCR [00]
divisor
latch
enable
set
break
set
parity
even
parity
parity
enable
stop
bits
word
length
bit-1
word
length
bit-0
1
0
0
MCR [00]
Clock
select
0/
0/
loop
back
-OP2
-OP1
-RTS
-DTR
IRRT
enable
Xon
Any
1
0
1
LSR [60]
0/
trans.
empty
trans.
holding
empty
break
interrupt
framing
error
parity
error
overrun
error
receive
data
ready
FIFO
error
1
1
0
MSR [X0]
-CD
-RI
-DSR
-CTS
delta
-CD
delta
-RI
delta
-DSR
delta
-CTS
1
1
1
SCPAD [FF]
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
Special Register Set Note *2
0
0
0
DLL [XX]
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
0
0
1
DLM [XX]
bit-15
bit-14
bit-13
bit-12
bit-11
bit-10
bit-9
bit-8
相關(guān)PDF資料
PDF描述
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