參數(shù)資料
型號(hào): XQ2V3000-4BG575M
廠商: Xilinx, Inc.
英文描述: QPro Virtex-II 1.5V Military QML Platform FPGAs
中文描述: QPro的Virtex - II 1.5V的軍事QML第平臺(tái)FPGA
文件頁(yè)數(shù): 55/128頁(yè)
文件大?。?/td> 2738K
代理商: XQ2V3000-4BG575M
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QPro Virtex-II 1.5V Military QML Platform FPGAs
DS122 (v1.1) January 7, 2004
Product Specification
www.xilinx.com
1-800-255-7778
55
R
IOB Output Switching Characteristics
Output delays terminating at a pad are specified for LVTTL with 12 mA drive and fast slew rate. For other standards, adjust
the delays with the values shown in
IOB Output Switching Characteristics Standard Adjustments
, page 56
.
Table 44:
IOB Output Switching Characteristics
Description
Symbol
Min
Max
Units
Propagation Delays
O input to Pad
T
IOOP
T
IOOLP
1.74
ns
O input to Pad via transparent latch
2.11
ns
3-State Delays
T input to Pad high-impedance
(1)
T
IOTHZ
T
IOTON
T
IOTLPHZ
T
IOTLPON
T
GTS
0.64
ns
T input to valid data on Pad
1.67
ns
T input to Pad high-impedance via transparent latch
(1)
1.01
ns
T input to valid data on Pad via transparent latch
2.04
ns
GTS to Pad high-impedance
(1)
5.98
ns
Sequential Delays
Clock CLK to Pad
T
IOCKP
T
IOCKHZ
T
IOCKON
2.15
ns
Clock CLK to Pad high-impedance (synchronous)
(1)
1.20
ns
Clock CLK to valid data on Pad (synchronous)
2.22
ns
Setup and Hold Times Before/After Clock CLK
O input
T
IOOCK
/T
IOCKO
T
IOOCECK
/T
IOCKOCE
T
IOSRCKO
/T
IOCKOSR
T
IOTCK
/T
IOCKT
T
IOTCECK
/T
IOCKTCE
T
IOSRCKT
/T
IOCKTSR
0.39/–0.11
ns
OCE input
0.24/–0.08
ns
SR input (OFF)
0.34/–0.07
ns
3
State Setup Times, T input
0.35/–0.08
ns
3
State Setup Times, TCE input
0.24/–0.08
ns
3
State Setup Times, SR input (TFF)
0.34/–0.07
ns
Set/Reset Delays
SR input to Pad (asynchronous)
T
IOSRP
T
IOSRHZ
T
IOSRON
T
IOGSRQ
2.98
ns
SR input to Pad high-impedance (asynchronous)
(1)
1.92
ns
SR input to valid data on Pad (asynchronous)
2.95
ns
GSR to Pad
6.88
ns
Notes:
1.
The 3-state turn-off delays should not be adjusted.
ds122_1_1.fm Page 55 Wednesday, January 7, 2004 9:15 PM
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