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參數(shù)資料
| 型號(hào)： | XPC855TZP50 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項(xiàng)-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 36/76頁 |
| 文件大?。?/td> | 825K |
| 代理商： | XPC855TZP50 |
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36
MPC850 (Rev. A/B/C) Hardware Specifications
MOTOROLA
Layout Practices
Figure 6-24 provides the PCMCIA access cycle timing for the external bus read.
Figure 6-24. PCMCIA Access Cycles Timing External Bus Read
P53
CLKOUT to ALE negate time
—
13.00
—
16.00
—
14.00
0.250
ns
P54
PCWE, IOWR negated to D[0–31]
invalid.
1
3.00
—
6.00
—
4.00
—
0.250
ns
P55
WAIT_B valid to CLKOUT rising edge.
1
8.00
—
8.00
—
8.00
—
—
ns
P56
CLKOUT rising edge to WAIT_B invalid.
1
2.00
—
2.00
—
2.00
—
—
ns
1
PSST = 1. Otherwise add PSST times cycle time.
PSHT = 0. Otherwise add PSHT times cycle time.
These synchronous timings define when the WAIT_B signal is detected in order to freeze (or relieve) the PCMCIA
current cycle. The WAIT_B assertion will be effective only if it is detected 2 cycles before the PSL timer expiration.
See PCMCIA Interface in the MPC850 PowerQUICC User’s Manual.
Table 6-8. PCMCIA Timing (continued)
Num
Characteristic
50MHz
66MHz
80 MHz
FFACTOR
Unit
Min
Max
Min
Max
Min
Max
CLKOUT
A[6:31]
REG
CE1/CE2
PCOE, IORD
TS
D[0:31]
ALE
B19
B18
P53
P52
P52
P51
P50
P48
P49
P46
P45
P44
P47
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XPC850CZT50BU | Microprocessor |
| XPC850CZT66BU | Microprocessor |
| XPC850DECZT50BU | Microprocessor |
| XPC850DECZT66BU | Microprocessor |
| XPC850DEZT50BU | Microprocessor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XPC855TZP50D4 | 制造商:Motorola Inc 功能描述: |
| XPC855TZP66D4 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Family Hardware Specifications |
| XPC855TZP80 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Controller Miscellaneous - Datasheet Reference |
| XPC855TZP80D4 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Family Hardware Specifications |
| XPC857DSLZP50B | 制造商:Freescale Semiconductor 功能描述: 制造商:Freescale Semiconductor 功能描述:MPU MPC8XX RISC 32BIT 0.32UM 50MHZ 357BGA - Trays |
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