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參數(shù)資料
| 型號(hào)： | XPC850DECVR50BU |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 22/72頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU POWERQUICC 50MHZ 256-PBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | MPC8xx |
| 處理器類型： | 32-位 MPC8xx PowerQUICC |
| 速度： | 50MHz |
| 電壓： | 3.3V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-LBGA |
| 供應(yīng)商設(shè)備封裝： | 256-PBGA（23x23） |
| 包裝： | 托盤 |
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MPC850 PowerQUICC Integrated Communications Processor Hardware Specifications, Rev. 2
Freescale Semiconductor
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Bus Signal Timing
Figure 17 provides the timing for the asynchronous asserted UPWAIT signal controlled by the UPM.
Figure 17. Asynchronous UPWAIT Asserted Detection in UPM Handled Cycles Timing
Figure 18 provides the timing for the asynchronous negated UPWAIT signal controlled by the UPM.
Figure 18. Asynchronous UPWAIT Negated Detection in UPM Handled Cycles Timing
CLKOUT
CSx
UPWAIT
GPL_A[0–5],
GPL_B[0–5]
BS_A[0:3],
BS_B[0:3]
B37
B38
CLKOUT
CSx
UPWAIT
GPL_A[0–5],
GPL_B[0–5]
BS_A[0:3],
BS_B[0:3]
B37
B38
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