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參數(shù)資料
| 型號(hào)： | XCS05-4PC84C |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 36/83頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 5V C-TEMP 84-PLCC |
| 標(biāo)準(zhǔn)包裝： | 15 |
| 系列： | Spartan® |
| LAB/CLB數(shù)： | 100 |
| 邏輯元件/單元數(shù)： | 238 |
| RAM 位總計(jì)： | 3200 |
| 輸入/輸出數(shù)： | 61 |
| 門(mén)數(shù)： | 5000 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 84-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 84-PLCC |
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Spartan and Spartan-XL FPGA Families Data Sheet
DS060 (v2.0) March 1, 2013
41
Product Specification
R
Product Obsolete/Under Obsolescence
Configuration Switching Characteristics
Master Mode
Slave Mode
DS060_33_080400
TPOR
VCC
PROGRAM
Mode Pins
(Required)
CCLK Output or Input
DONE Response
RE-PROGRAM
I/O
INIT
TPI
TCCLK
TICCK
>300 ns
<300 ns
Symbol
Description
Min
Max
Units
TPOR
Power-on reset
40
130
ms
TPI
Program Latency
30
200
μs per CLB column
TICCK
CCLK (output) delay
40
250
μs
TCCLK
CCLK (output) period, slow
640
2000
ns
TCCLK
CCLK (output) period, fast
100
250
ns
Symbol
Description
Min
Max
Units
TPOR
Power-on reset
10
33
ms
TPI
Program latency
30
200
μs per CLB column
TICCK
CCLK (input) delay (required)
4
-
μs
TCCLK
CCLK (input) period (required)
80
-
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XCS05-3VQ100I | IC FPGA 5V I-TEMP 100-VQFP |
| XCS05-3PC84C | IC FPGA 5V C-TEMP 84-PLCC |
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| IDT7024L15J8 | IC SRAM 64KBIT 15NS 84PLCC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XCS05-4PC84I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan and Spartan-XL FPGA |
| XCS05-4PQ100C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
| XCS05-4PQ100I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
| XCS05-4PQ144C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
| XCS05-4PQ144I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
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