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    參數(shù)資料
    

    


    


    
型號：
XC5VTX150T-1FFG1156I

    

    
廠商：
Xilinx Inc

    

    
文件頁數(shù)：
87/91頁

    

    
文件大小：
0K

    

    
描述：
IC FPGA VIRTEX5TXT 150K 1156FBGA

    

    
產(chǎn)品培訓模塊：
PCI Express and Virtex® -5 FPGAs
    		

    

    
標準包裝：
1

    

    
系列：
Virtex®-5 TXT

    

    
LAB/CLB數(shù)：
11600
    		

    

    
邏輯元件/單元數(shù)：
148480
    		

    

    
RAM 位總計：
8404992
    		

    

    
輸入/輸出數(shù)：
360
    		

    

    
電源電壓：
0.95 V ~ 1.05 V
    		

    

    
安裝類型：
表面貼裝
    		

    

    
工作溫度：
-40°C ~ 100°C
    		

    

    
封裝/外殼：
1156-BBGA，F(xiàn)CBGA
    		

    

    
供應(yīng)商設(shè)備封裝：
1156-FCBGA（35x35）
    		

    

    
配用：
568-5088-ND - BOARD DEMO DAC1408D750
    		

    

    

    

	
    
    
    

    
    
	
    Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
    DS202 (v5.3) May 5, 2010
    Product Specification
    88
    05/18/07
    3.1
    Added typical values for n and r in Table 3.
    Revised and added values to Table 4.
    Revised standard I/O levels in Table 7.
    Changed the design software version that matches this data sheet above Table 54 on page 30.
    In Switching Characteristics, the following values are revised:
    LVTTL, Slow and Fast, 2 mA, 4 mA, and 6 mA (Table 56).
    LVCMOS33, Slow and Fast, 2 mA, 4 mA, and 6 mA (Table 56).
    LVCMOS25, Slow and Fast, 2 mA and 4 mA, and Fast 12 mA (Table 56).
    LVCMOS18, Slow and Fast, 2 mA, 4 mA, and 6 mA (Table 56).
    LVCMOS15 and LVCMOS12, Slow and Fast, 2 mA (Table 56).
    TIDOCK and TIDOCKD in Table 60.
    Setup/Hold for Control Lines and Data Lines in Table 62.
    Add TIDELAYPAT_JIT and revised TIDELAYRESOLUTION in Table 64, page 44 and added Notes 1 and 2.
    Revised TRCK page 45 and removed TCKSR Table 65, page 44.
    Replaced TTWC with TMCP symbol in Table 66, page 46.
    Revised TCECK in Table 67.
    Revised TRCKO_FLAGS and TRDCK_DI_ECC encode only in Table 68.
    Revised Hold Times of Data/Control Pins to the Input Register Clock.
    Setup/Hold times of {PCIN, CARRYCASCIN, MULTSIGNIN} input to P register CLK. Hold times of
    some of the CE pins. Hold times of some of the RST pins. Hold times of {A, B} input to {P,
    CARRYOUT} output using multiplier and {ACIN, BCIN} input to {P, CARRYOUT} output using
    multiplier, CLK (AREG, BREG) to {P, CARRYOUT} output using multiplier, in Table 69.
    Updated and added values to Table 70, page 51.
    Revised -1 speed FMAX value in Table 72, page 53.
    Added Note 4 to TLOCKMAX and revised FINDUTY, FINMAX,and FVCOMAX in Table 74, page 55.
    Added ± values to Table 79 and Table 80. Changed TOUT_OFFSET in Table 80.
    Revised values in Table 84 through Table 90.
    Revised values in Table 91 through Table 97.
    Revised values in Table98, page83.
    Added package skew values to Table 99, page 84.
    Revised values in Table 101, page 85.
    06/15/07
    3.2
    Updated TSTG in Table 1.
    Corrected VOH/VOL in Table 9 and Table10, page8.
    Changed the design software version that matches this data sheet above Table 54 on page 30.
    Added TIODELAY_CLK_MAX and revised TCKSR in Table 64, page 44.
    Corrected units to ns in Table 98, page 83.
    Date
    Version
    Revision
    
    
    
    
    
    


    


    

    相關(guān)PDF資料
    		

    PDF描述
    		

    
    

    
XC5VTX150T-1FF1156I
IC FPGA VIRTEX5TXT 150K 1156FBGA

    

    
ASM36DTBT-S664
CONN EDGECARD 72POS R/A .156

    

    
AGM36DTBT-S664
CONN EDGECARD 72POS R/A .156

    

    
XC5VSX95T-2FFG1136I
IC FPGA VIRTEX-5 95K 1136FBGA

    

    
XC5VSX95T-2FF1136I
IC FPGA VIRTEX-5 95K 1136FBGA

    

    

    

    


    


    

    相關(guān)代理商/技術(shù)參數(shù)
    		

    參數(shù)描述
    		

    
    

    
XC5VTX150T-1FFG1759C
功能描述:IC FPGA VIRTEX5TXT 150K 1759FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-5 TXT 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55）

    

    
XC5VTX150T-1FFG1759I
功能描述:IC FPGA VIRTEX5TXT 150K 1759FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-5 TXT 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55）

    

    
XC5VTX150T-2FF1156C
功能描述:IC FPGA VIRTEX5TXT 150K 1156FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-5 TXT 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55）

    

    
XC5VTX150T-2FF1156I
功能描述:IC FPGA VIRTEX5TXT 150K 1156FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-5 TXT 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55）

    

    
XC5VTX150T-2FF1759C
功能描述:IC FPGA VIRTEX5TXT 150K 1759FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-5 TXT 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55）

    

    
    
    
    
	
    	
    
    
     
     
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                                    廠商
                                    批號
                                    封裝
                                  
    
                                    
                                
                                
    
                                    
                                        
    
                                            
                                            
                                        
    
                                        		
                                     
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                  
    
                                  
                                   
                                    
                            
    
                             
                             
							                            
    
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    我的聯(lián)系方式
    
                     
                     
                       
    
                                
                                
                                
    
                                    
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