參數(shù)資料
型號： XC4VLX80-10FFG1148C
廠商： Xilinx Inc
文件頁數(shù)： 10/58頁
文件大?。?/td> 0K
描述： IC FPGA VIRTEX-4 80K 1148-FBGA
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-4 LX
LAB/CLB數(shù)： 8960
邏輯元件/單元數(shù)： 80640
RAM 位總計： 3686400
輸入/輸出數(shù)： 768
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1148-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 1148-FCPBGA（35x35）
其它名稱： 122-1497
Virtex-4 FPGA Data Sheet: DC and Switching Characteristics
DS302 (v3.7) September 9, 2009
Product Specification
18
Table 26: RocketIO Transmitter Switching Characteristics
Description
Symbol
Conditions
Min
Typ
Max
Units
Serial data rate, -10
FGTX
0.622
3.125
Gb/s
Serial data rate, -11
FGTX
0.622
6.5
Gb/s
Data
Rate (Gb/s)
TX Jitter Generation(3)
TJ
PRBS7
6.5
0.50
UI(1)
RJ
0.35
DJ
0.30
TJ
PRBS7
5.0
0.45
RJ
0.30
DJ
0.25
TJ
PRBS7
4.25
0.40
RJ
0.25
DJ
0.21
TJ
PRBS7
3.125
0.28
RJ
0.14
DJ
0.14
TJ
PRBS7
2.5
0.25
RJ
0.18
DJ
0.12
TJ
PRBS7
1.25
0.12
RJ
0.10
DJ
0.06
TJ
PRBS31
0.622
0.08
RJ
0.06
DJ
0.04
TX rise time(2)
TRTX
20% – 80%
90
ps
TX fall time(2)
TFTX
20% – 80%
90
ps
TXUSRCLK frequency
For slower speed grades =
MaxDataRate/32
250
MHz
TXUSRCLK2 frequency
250
MHz
TXUSRCLK duty cycle
TTXDC
40
60
%
TXUSRCLK2 duty cycle
TTX2DC
40
60
%
Differential output skew
TISKEW
12
20
ps
Electrical idle transition time
TXOOBTransition
15
ns
Notes:
1.
UI = Unit Interval.
2.
Default attributes, measured at 2.5 Gb/s.
3.
Peak-to-Peak values measured relative to 1e-12 Error rate. Default attributes. TX feedback divider (TXPLLNDIVSEL) = 10.
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