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參數(shù)資料
| 型號： | XC4VFX12-12FFG668C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 40/58頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA VIRTEX-4 FX 12K 668FCBGA |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Virtex®-4 FX |
| LAB/CLB數(shù)： | 1368 |
| 邏輯元件/單元數(shù)： | 12312 |
| RAM 位總計： | 663552 |
| 輸入/輸出數(shù)： | 320 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 668-BBGA，F(xiàn)CBGA |
| 供應(yīng)商設(shè)備封裝： | 668-FCBGA |
| 配用： | HW-V4-ML403-UNI-G-ND - EVALUATION PLATFORM VIRTEX-4 HW-AFX-FF668-400-ND - BOARD DEV VIRTEX 4 FF668 |
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Virtex-4 FPGA Data Sheet: DC and Switching Characteristics
DS302 (v3.7) September 9, 2009
Product Specification
45
Table 55: Global Clock Input to Output Delay for LVCMOS25 Standard, 12 mA, Fast Slew Rate, without DCM
Symbol
Description
Device
Speed Grade
Units
-12
-11
-10
LVCMOS25 Global Clock Input to Output Delay using Output Flip-Flop, 12 mA, Fast Slew Rate, without DCM.
TICKOF
Global Clock and OFF without DCM
XC4VLX15
6.42
7.22
8.14
ns
XC4VLX25
6.50
7.32
8.25
ns
XC4VLX40
6.70
7.54
8.50
ns
XC4VLX60
6.86
7.72
8.70
ns
XC4VLX80
6.98
7.85
8.85
ns
XC4VLX100
7.23
8.15
9.18
ns
XC4VLX160
7.46
8.40
9.46
ns
XC4VLX200
N/A
8.79
9.88
ns
XC4VSX25
6.69
7.52
8.47
ns
XC4VSX35
6.75
7.59
8.56
ns
XC4VSX55
7.10
7.99
9.00
ns
XC4VFX12
6.41
7.21
8.13
ns
XC4VFX20
6.60
7.42
8.37
ns
XC4VFX40
6.97
7.84
8.83
ns
XC4VFX60
6.98
7.86
8.85
ns
XC4VFX100
7.46
8.40
9.45
ns
XC4VFX140
N/A
8.80
9.90
ns
Notes:
1.
Listed above are representative values where one global clock input drives one vertical clock line in each accessible column, and where all
accessible IOB and CLB flip-flops are clocked by the global clock net.
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