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參數(shù)資料
| 型號(hào)： | XC3S500E-5PQG208C |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 34/227頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA SPARTAN-3E 500K 208-PQFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | Spartan®-3E |
| LAB/CLB數(shù)： | 1164 |
| 邏輯元件/單元數(shù)： | 10476 |
| RAM 位總計(jì)： | 368640 |
| 輸入/輸出數(shù)： | 158 |
| 門數(shù)： | 500000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 208-PQFP（28x28） |
| 配用： | 122-1536-ND - KIT STARTER SPARTAN-3E |
| 其它名稱： | 122-1719 XC3S500E-5PQG208C-ND |
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Spartan-3E FPGA Family: DC and Switching Characteristics
DS312 (v4.1) July 19, 2013
Product Specification
129
Table 92: Timing for the IOB Output Path
Symbol
Description
Conditions
Device
Speed Grade
Units
-5
-4
Min
Clock-to-Output Times
TIOCKP
When reading from the Output Flip-Flop (OFF), the
time from the active transition at the OCLK input to
data appearing at the Output pin
LVCMOS25(2),
12 mA output drive,
Fast slew rate
All
2.18
2.50
ns
Propagation Times
TIOOP
The time it takes for data to travel from the IOB’s O
input to the Output pin
LVCMOS25(2),
12 mA output drive,
Fast slew rate
All
2.24
2.58
ns
TIOOLP
The time it takes for data to travel from the O input
through the OFF latch to the Output pin
2.32
2.67
ns
Set/Reset Times
TIOSRP
Time from asserting the OFF’s SR input to
setting/resetting data at the Output pin
LVCMOS25(2),
12 mA output drive,
Fast slew rate
All
3.27
3.76
ns
TIOGSRQ
Time from asserting the Global Set Reset (GSR)
input on the STARTUP_SPARTAN3E primitive to
setting/resetting data at the Output pin
8.40
9.65
ns
Notes:
1.
The numbers in this table are tested using the methodology presented in Table 95 and are based on the operating conditions set forth in
2.
This time requires adjustment whenever a signal standard other than LVCMOS25 with 12 mA drive and Fast slew rate is assigned to the data
Output. When this is true, add the appropriate Output adjustment from Table 94.
3.
For minimum delays use the values reported by the Timing Analyzer.
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