參數(shù)資料
型號(hào)： XC3S200-5TQG144C
廠商： Xilinx Inc
文件頁(yè)數(shù)： 245/272頁(yè)
文件大?。?/td> 0K
描述： SPARTAN-3A FPGA 200K 144-TQFP
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 60
系列： Spartan®-3
LAB/CLB數(shù)： 480
邏輯元件/單元數(shù)： 4320
RAM 位總計(jì)： 221184
輸入/輸出數(shù)： 97
門數(shù)： 200000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
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Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
74
LVCMOS15
0.42
0.49
ns
LVDCI_15
0.38
0.43
ns
LVDCI_DV2_15
0.38
0.44
ns
LVCMOS18
0.24
0.28
ns
LVDCI_18
0.29
0.33
ns
LVDCI_DV2_18
0.28
0.33
ns
LVCMOS25
0
ns
LVDCI_25
0.05
ns
LVDCI_DV2_25
0.04
ns
LVCMOS33, LVDCI_33, LVDCI_DV2_33
–0.05
–0.02
ns
LVTTL
0.18
0.21
ns
PCI33_3
0.20
0.22
ns
SSTL18_I, SSTL18_I_DCI
0.39
0.45
ns
SSTL18_II
0.39
0.45
ns
SSTL2_I, SSTL2_I_DCI
0.40
0.46
ns
SSTL2_II, SSTL2_II_DCI
0.36
0.41
ns
Differential Standards
LDT_25 (ULVDS_25)
0.76
0.88
ns
LVDS_25, LVDS_25_DCI
0.65
0.75
ns
BLVDS_25
0.34
0.39
ns
LVDSEXT_25, LVDSEXT_25_DCI
0.80
0.92
ns
LVPECL_25
0.18
0.21
ns
RSDS_25
0.43
0.50
ns
DIFF_HSTL_II_18, DIFF_HSTL_II_18_DCI
0.34
0.39
ns
DIFF_SSTL2_II, DIFF_SSTL2_II_DCI
0.65
0.75
ns
Notes:
1.
The numbers in this table are tested using the methodology presented in Table 48 and are based on
the operating conditions set forth in Table 32, Table 35, and Table 37.
2.
These adjustments are used to convert input path times originally specified for the LVCMOS25
standard to times that correspond to other signal standards.
Table 44: Input Timing Adjustments for IOB (Cont’d)
Convert Input Time from LVCMOS25 to the
Following Signal Standard (IOSTANDARD)
Add the Adjustment Below
Units
Speed Grade
-5
-4
相關(guān)PDF資料
PDF描述
XC2S50E-6TQG144C IC SPARTAN-IIE FPGA 50K 144-TQFP
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AMM25DSAN CONN EDGECARD 50POS R/A .156 SLD
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XC3S200-5VQG100I 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet
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