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參數(shù)資料
| 型號： | XC3S1600E-4FGG484I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 45/227頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA SPARTAN-3E 1600K 484FBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | Spartan®-3E |
| LAB/CLB數(shù)： | 3688 |
| 邏輯元件/單元數(shù)： | 33192 |
| RAM 位總計(jì)： | 663552 |
| 輸入/輸出數(shù)： | 376 |
| 門數(shù)： | 1600000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 484-BBGA |
| 供應(yīng)商設(shè)備封裝： | 484-FBGA |
| 配用： | HW-XA3S1600E-UNI-G-ND - KIT DEVELOPMENT AUTOMOTIVE ECU |
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Spartan-3E FPGA Family: DC and Switching Characteristics
DS312 (v4.1) July 19, 2013
Product Specification
139
Block RAM Timing
Table 103: Block RAM Timing
Symbol
Description
Speed Grade
Units
-5
-4
Min
Max
Min
Max
Clock-to-Output Times
TBCKO
When reading from block RAM, the delay from the active
transition at the CLK input to data appearing at the DOUT
output
-2.45
-2.82
ns
Setup Times
TBACK
Setup time for the ADDR inputs before the active transition at
the CLK input of the block RAM
0.33
-0.38
-ns
TBDCK
Setup time for data at the DIN inputs before the active
transition at the CLK input of the block RAM
0.23
-0.23
-ns
TBECK
Setup time for the EN input before the active transition at the
CLK input of the block RAM
0.67
-0.77
-ns
TBWCK
Setup time for the WE input before the active transition at the
CLK input of the block RAM
1.09
-1.26
-ns
Hold Times
TBCKA
Hold time on the ADDR inputs after the active transition at the
CLK input
0.12
-0.14
-ns
TBCKD
Hold time on the DIN inputs after the active transition at the
CLK input
0.12
-0.13
-ns
TBCKE
Hold time on the EN input after the active transition at the CLK
input
0
-0
-ns
TBCKW
Hold time on the WE input after the active transition at the CLK
input
0
-0
-ns
Clock Timing
TBPWH
High pulse width of the CLK signal
1.39
-1.59
-ns
TBPWL
Low pulse width of the CLK signal
1.39
-1.59
-ns
Clock Frequency
FBRAM
Block RAM clock frequency. RAM read output value written
back into RAM, for shift-registers and circular buffers.
Write-only or read-only performance is faster.
02700230
MHz
Notes:
1.
The numbers in this table are based on the operating conditions set forth in Table 77.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 25LC160B-E/MS | IC EEPROM 16KBIT 10MHZ 8MSOP |
| 25LC160AT-E/ST | IC EEPROM 16KBIT 10MHZ 8TSSOP |
| 25LC160AT-E/MS | IC EEPROM 16KBIT 10MHZ 8MSOP |
| XC3S5000-4FGG676C | SPARTAN-3A FPGA 5M STD 676-FBGA |
| 25LC160A-E/ST | IC EEPROM 16KBIT 10MHZ 8TSSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC3S1600E-4FT256C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4FT256I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4FTG256C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4FTG256I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4PQ208C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3E FPGA Family |
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