參數(shù)資料
型號(hào)： XC3S1600E-4FG320I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 121/227頁(yè)
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3E 320FBGA
標(biāo)準(zhǔn)包裝： 84
系列： Spartan®-3E
LAB/CLB數(shù)： 3688
邏輯元件/單元數(shù)： 33192
RAM 位總計(jì)： 663552
輸入/輸出數(shù)： 250
門數(shù)： 1600000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
207
Footprint Migration Differences
Table 151 summarizes any footprint and functionality
differences between the XC3S500E, the XC3S1200E, and
the XC3S1600E FPGAs that may affect easy migration
between devices available in the FG320 package. There are
26 such balls. All other pins not listed in Table 151
unconditionally migrate between Spartan-3E devices
available in the FG320 package.
The XC3S500E is duplicated on both the left and right sides
of the table to show migrations to and from the XC3S1200E
and the XC3S1600E. The arrows indicate the direction for
easy migration. A double-ended arrow (
) indicates that
the two pins have identical functionality. A left-facing arrow
(
) indicates that the pin on the device on the right
unconditionally migrates to the pin on the device on the left.
It may be possible to migrate the opposite direction
depending on the I/O configuration. For example, an I/O pin
(Type = I/O) can migrate to an input-only pin
(Type = INPUT) if the I/O pin is configured as an input.
Table 151: FG320 Footprint Migration Differences
Pin
Bank
XC3S500E
Migration
XC3S1200E
Migration
XC3S1600E
Migration
XC3S500E
A7
0
INPUT
I/O
I/O
INPUT
A12
0
N.C.
I/O
I/O
N.C.
D4
3
N.C.
I/O
I/O
N.C.
D6
0
N.C.
I/O
I/O
N.C.
D13
0
INPUT
I/O
I/O
INPUT
E3
3
N.C.
I/O
I/O
N.C.
E4
3
N.C.
I/O
I/O
N.C.
E6
0
N.C.
I/O
I/O
N.C.
E15
1
N.C.
I/O
I/O
N.C.
E16
1
N.C.
I/O
I/O
N.C.
E17
1
I/O
INPUT
INPUT
I/O
F4
3
I/O
INPUT
INPUT
I/O
N12
2
N.C.
I/O
I/O
N.C.
N14
1
N.C.
I/O
I/O
N.C.
N15
1
N.C.
I/O
I/O
N.C.
P3
3
N.C.
I/O
I/O
N.C.
P4
3
N.C.
I/O
I/O
N.C.
P12
2
N.C.
I/O
I/O
N.C.
P15
1
I/O
INPUT
INPUT
I/O
P16
1
N.C.
I/O
I/O
N.C.
R4
3
VREF(I/O)
VREF(INPUT)
VREF(INPUT)
VREF(I/O)
U6
2
INPUT
I/O
I/O
INPUT
U13
2
INPUT
I/O
I/O
INPUT
V5
2
N.C.
I/O
I/O
N.C.
V6
2
N.C.
VREF
VREF
N.C.
V7
2
N.C.
I/O
I/O
N.C.
DIFFERENCES
26
0
26
Legend:
This pin is identical on the device on the left and the right.
This pin can unconditionally migrate from the device on the left to the device on the right. Migration in the other direction may be
possible depending on how the pin is configured for the device on the right.
This pin can unconditionally migrate from the device on the right to the device on the left. Migration in the other direction may be
possible depending on how the pin is configured for the device on the left.
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PDF描述
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XC3S1600E-4FG484C 制造商:Xilinx 功能描述:FPGA SPARTAN-3E 1.6M GATES 33192 CELLS 572MHZ 90NM 1.2V 484F - Trays
XC3S1600E-4FG484CES 制造商:Xilinx 功能描述:
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