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參數資料
| 型號： | XC2C64A-7VQG100C |
| 廠商： | Xilinx Inc |
| 文件頁數： | 15/16頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CR-II CPLD 64MCELL 100-VQFP |
| 標準包裝： | 90 |
| 系列： | CoolRunner II |
| 可編程類型： | 系統(tǒng)內可編程 |
| 最大延遲時間 tpd(1)： | 6.7ns |
| 電壓電源 - 內部： | 1.7 V ~ 1.9 V |
| 邏輯元件/邏輯塊數目： | 4 |
| 宏單元數： | 64 |
| 門數： | 1500 |
| 輸入/輸出數： | 64 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-TQFP |
| 供應商設備封裝： | 100-VQFP（14x14） |
| 包裝： | 托盤 |
| 產品目錄頁面： | 600 (CN2011-ZH PDF) |
| 配用： | 122-1536-ND - KIT STARTER SPARTAN-3E 122-1532-ND - KIT DEVELOPMENT SPARTAN 3ADSP |
| 其它名稱： | 122-1409 |
CoolRunner-II CPLD Family
8
DS090 (v3.1) September 11, 2008
Product Specification
R
nally generated DataGATE control logic can be assigned to
this I/O pin with the BUFG=DATA_GATE attribute.
Global Signals
Global signals, clocks (GCK), sets/resets (GSR), and output
enables (GTS), are designed to strongly resemble each
other. This approach enables design software to make the
best utilization of their capabilities. Each global capability is
supplemented by a corresponding product term version.
Figure 7 shows the common structure of the global signal
trees. The pin input is buffered, then drives multiple internal
global signal traces to deliver low skew and reduce loading
delays. GCK, GSR, and GTS can also be used as general
purpose I/Os if they are not needed as global signals. The
DataGATE assertion rail is also a global signal.
Figure 6: DataGATE Architecture (output drivers not shown)
PLA
MC1
MC2
MC16
DS090_06_111201
PLA
DataGATE Assertion Rail
PLA
AIM
MC1
MC2
MC16
MC1
MC2
MC16
MC1
MC2
MC16
To AIM
Latch
To AIM
Latch
To AIM
Latch
To AIM
Latch
Figure 7: Global Clocks (GCK), Sets/Resets (GSR), and
Output Enables (GTS)
DS090_07_101001
相關PDF資料 |
PDF描述 |
|---|---|
| RBM12DRKH | CONN EDGECARD 24POS DIP .156 SLD |
| EGM43DTBT-S189 | CONN EDGECARD 86POS R/A .156 SLD |
| REC3-2412SR/H1/SMD-R | CONV DC/DC 3W 24VIN 12VOUT |
| TAP334M035HSB | CAP TANT 0.33UF 35V 20% RADIAL |
| EMM06DRMS | CONN EDGECARD 12POS .156 WW |
相關代理商/技術參數 |
參數描述 |
|---|---|
| XC2C64A-7VQG100I | 功能描述:IC CR-II CPLD 64MCELL 100-VQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - CPLD（復雜可編程邏輯器件） 系列:CoolRunner II 標準包裝:90 系列:ispMACH® 4A 可編程類型:系統(tǒng)內可編程 最大延遲時間 tpd(1):7.5ns 電壓電源 - 內部:4.75 V ~ 5.25 V 邏輯元件/邏輯塊數目:- 宏單元數:64 門數:- 輸入/輸出數:48 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:100-LQFP 供應商設備封裝:100-TQFP（14x14） 包裝:托盤 |
| XC2C64A-7VQG44C | 功能描述:IC CR-II CPLD 64MCELL 44-VQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - CPLD（復雜可編程邏輯器件） 系列:CoolRunner II 標準包裝:90 系列:ispMACH® 4A 可編程類型:系統(tǒng)內可編程 最大延遲時間 tpd(1):7.5ns 電壓電源 - 內部:4.75 V ~ 5.25 V 邏輯元件/邏輯塊數目:- 宏單元數:64 門數:- 輸入/輸出數:48 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:100-LQFP 供應商設備封裝:100-TQFP（14x14） 包裝:托盤 |
| XC2C64A-7VQG44I | 功能描述:IC CR-II CPLD 64MCELL 44-VQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - CPLD（復雜可編程邏輯器件） 系列:CoolRunner II 標準包裝:90 系列:ispMACH® 4A 可編程類型:系統(tǒng)內可編程 最大延遲時間 tpd(1):7.5ns 電壓電源 - 內部:4.75 V ~ 5.25 V 邏輯元件/邏輯塊數目:- 宏單元數:64 門數:- 輸入/輸出數:48 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:100-LQFP 供應商設備封裝:100-TQFP（14x14） 包裝:托盤 |
| XC2C64SERIES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CoolRunner-II CPLD |
| XC2JC101 | 制造商:Schneider Electric 功能描述:LIMIT SWITCH 600VDC 10AMP XC2J +OPTIONS 制造商:SCHNEIDER ELECTRIC 功能描述:Switch Access Limit Switch |
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