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參數(shù)資料
| 型號： | X98017L128-3.3-Z |
| 廠商： | Intersil |
| 文件頁數(shù)： | 27/29頁 |
| 文件大小： | 0K |
| 描述： | IC VIDEO DIGITIZER TRPL 128MQFP |
| 標準包裝： | 66 |
| 類型： | 視頻數(shù)字轉換器，3 通道 AFE |
| 應用： | LCD 電視機/監(jiān)控器 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-BFQFP |
| 供應商設備封裝： | 128-MQFP（14x20） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 1247 (CN2011-ZH PDF) |
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7
FN8218.3
March 8, 2006
t
HSYNCin-to-HSout = 7.5ns + (PHASE/64 +10.5)*tPIXEL
D
1
D
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Programmable
Width and Polarity
Analog
Video In
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P/GP/BP[7:0]
HS
OUT
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D
2
The HSYNC edge (programmable leading or trailing) that the DPLL is locked to.
The sampling phase setting determines its relative position to the rest of the AFE’s output signals
DATACLK
R
S/GS/BS[7:0]
HSYNC
IN
The HSYNC edge (programmable leading or trailing) that the DPLL is locked to.
HSYNC
FIGURE 5. 48 BIT OUTPUT MODE
Programmable
Width and Polarity
Analog
Video In
P
1
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P
8
P
0
P
9
HS
OUT
P
10
P
11
The HSYNC edge (programmable leading or trailing) that the DPLL is locked to.
The sampling phase setting determines its relative position to the rest of the AFE’s output signals
DATACLK
HSYNC
IN
D
0
R
P/GP/BP[7:0]
D
2
D
1
R
S/GS/BS[7:0]
t
HSYNCin-to-HSout = 7.5ns + (PHASE/64 +8.5)*tPIXEL
FIGURE 6. 48 BIT OUTPUT MODE, INTERLEAVED TIMING
X98017
相關PDF資料 |
PDF描述 |
|---|---|
| X98021L128-3.3-Z | IC TRPL VID DIGITIZER 128MQFP |
| X98024L128-3.3-Z | IC TRPL VID DIGITIZER 128MQFP |
| X98027L128-3.3-Z | IC TRPL VID DIGITIZER 128MQFP |
| XC25BS5001MR-G | IC CLK BUFFER PLL SOT26 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| X98021L128-3.3 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:210MHz Triple Video Digitizer with Digital PLL |
| X98021L128-3.3-Z | 功能描述:IC TRPL VID DIGITIZER 128MQFP RoHS:是 類別:集成電路 (IC) >> 線性 - 視頻處理 系列:- 標準包裝:250 系列:- 類型:電平移位器 應用:LCD 電視機/監(jiān)控器 安裝類型:表面貼裝 封裝/外殼:28-WFQFN 裸露焊盤 供應商設備封裝:28-WQFN（4x4）裸露焊盤 包裝:帶卷 (TR) 其它名稱:296-32523-2TPS65198RUYT-ND |
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