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參數(shù)資料
| 型號(hào)： | X9252TV24IZ-2.7 |
| 廠商： | INTERSIL CORP |
| 元件分類(lèi)： | 數(shù)字電位計(jì) |
| 英文描述： | Low Power + Quad 256-Tap + 2-Wire Bus + Up/Down Interface |
| 中文描述： | QUAD 100K DIGITAL POTENTIOMETER, 2-WIRE SERIAL CONTROL INTERFACE, 256 POSITIONS, PDSO24 |
| 封裝： | ROHS COMPLIANT, PLASTIC, TSSOP-24 |
| 文件頁(yè)數(shù)： | 6/19頁(yè) |
| 文件大?。?/td> | 389K |
| 代理商： | X9252TV24IZ-2.7 |
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6
FN8167.1
September 14, 2005
SDA vs SCL Timing
WP, A0, A1, and A2 Pin Timing
t
BUF
(Note 5)
Bus Free Time (Prior to Any Transmission)
1200
ns
t
SU:WPA
(Note 5)
A0, A1, A2 and WP Setup Time
600
ns
t
HD:WPA
(Note 5)
A0, A1, A2 and WP Hold Time
600
ns
2-Wire Interface timing (s)
(Continued)
SYMBOL
PARAMETER
MIN
MAX
UNITS
t
SU:STO
t
DH
t
HIGH
t
SU:STA
t
HD:STA
t
HD:DAT
t
SU:DAT
SCL
SDA
(Input Timing)
SDA
(Output Timing)
t
F
t
LOW
t
BUF
t
AA
t
R
t
HD:WP
SCL
SDA IN
WP, A0, A1, or A2
t
SU:WP
Clk 1
START
STOP
Increment/Decrement Timing
SYMBOL
PARAMETER
MIN
TYP (Note 4)
MAX
UNITS
t
CI
CS to SCL Setup
600
ns
t
ID
(Note 5)
SCL HIGH to U/D, DS0 or DS1 change
600
ns
t
DI
(Note 5)
U/D, DS0 or DS1 to SCL setup
600
ns
t
IL
SCL LOW period
2.5
μs
t
IH
SCL HIGH period
2.5
μs
t
IC
SCL inactive to CS inactive (Nonvolatile Store Setup Time)
1
μs
t
CPHS
CS deselect time (STORE)
10
ms
t
CPHNS
(Note 5)
CS deselect time (NO STORE)
1
μs
t
IW
(Note 5)
SCL to R
W
change
100
500
μs
t
CYC
SCL cycle time
5
μs
t
R
, t
F
(Note 5) SCL input rise and fall time
500
μs
X9252
相關(guān)PDF資料 |
PDF描述 |
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