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參數(shù)資料
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W9864G6IH
Publication Release Date: Mar. 22, 2010
- 21 -
Revision A11
10.4 Mode Register Set Cycle
A0
A3
Addressing Mode
0
Sequential
1
Interleave
A0
A9
Single Write Mode
0
Burst read and Burst write
1
Burst read and single write
A0
A2 A1 A0
A0
0
A0
0
1
A0
0
1
0
A0
0
1
A0
1
0
A0
1
0
1
A0
1
0
A0
1
Burst Length
Sequential
Interleave
1
2
4
8
Reserved
Full Page
CAS Latency
Reserved
2
3
Reserved
A0
A6 A5 A4
A0
0
A0
0
1
0
A0
0
1
A0
1
0
A0
0
1
* "Reserved" should stay "0" during MRS cycle.
tRSC
tCMS
tCMH
tCMS
tCMH
tCMS
tCMH
tCMS
tCMH
tAS
t
CLK
CS
RAS
CAS
WE
A0-A11
BS0,1
Register
set data
next
command
A0
A1
A2
A3
A4
A5
A6
Burst Length
Addressing Mode
CAS Latency
(Test Mode)
A8
A0
A7
A9
A0
Write Mode
A10
BS0
A0
A11
"0"
Reserved
BS1
"0"
Reserved
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| W9864G6JH | 制造商:WINBOND 制造商全稱(chēng):Winbond 功能描述:1M ? 4 BANKS ? 16 BITS SDRAM |
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