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參數(shù)資料
| 型號(hào)： | UPD78F1224GB-GAG-AX |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 488/1067頁 |
| 文件大小： | 0K |
| 描述： | MCU 16BIT 78K0R/LX3 52-LQFP |
| 標(biāo)準(zhǔn)包裝： | 300 |
| 系列： | 78K0R/Ix3 |
| 核心處理器： | 78K/0R |
| 芯體尺寸： | 16-位 |
| 速度： | 40MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設(shè)備： | DMA，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 40 |
| 程序存儲(chǔ)器容量： | 48KB（48K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 11x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 52-LQFP |
| 包裝： | 托盤 |
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CHAPTER 7 INVERTER CONTROL FUNCTIONS
User’s Manual U19678EJ1V1UD
475
Figure 7-77. Operation Procedure of Linked Real-Time Output Function (Type 3) (2/2)
Software Operation
Hardware Status
During
operation
Set value of the TDR00 and TDRn registers can be
changed.
The TCR00 and TCRn registers can always be read.
Set values of the TROn and TROm bits can be
changed.
The counter of the master channel loads the TDR00 value
to TCR00 and counts down. When the count value reaches
TCR00 = 0000H, INTTM00 is generated. At the same time,
the value of the TDR00 register is loaded to TCR00, and
the counter starts counting down again.
At slave channel 1, the value of the TDRn register is
transferred to TCRn, triggered by TSn = 1, and the counter
starts counting down. When the counter has counted down
to 0000H, INTTMn is output and the counting operation is
stopped. After that, the above operation is repeated. The
set value of TROm of the slave channels 2 to 7 (real-time
output channel) is output from TOm at the INTTMn output
timing.
The TT00 (master) and TTn (slave 1) bits are set to 1 at
the same time.
The TT00 and TTn bits automatically return to 0
because they are trigger bits.
TE00, TEn = 0, and count operation stops.
TCR00 and TCRn hold count value and stops.
The TOn and TOm output is not initialized but holds
current status.
Operation
stop
The TOEn and TOEm bits are cleared to 0 and values
are set to TOn and TOm.
The set values of TOn and TOm initialize the outputs of
TOn and TOm.
To hold the TOn and TOm pin output levels
Clears the TOn and TOm bits to 0 after the values to
be held are set to the port register.
When holding the TOn and TOm pin output levels is not
necessary
Switches the port mode register to input mode.
The TOn and TOm pin output levels are held by port
function.
The TOn and TOm pin output levels go into Hi-Z output
state.
TAUS stop
The TAU0EN and TAUOPEN bits of the PER2 register
are cleared to 0.
Power-off status
All circuits are initialized and SFR of each channel is also
initialized.
(The TOn and TOm bits are cleared to 0 and the TOn
and TOm pins are set to port mode.)
Remark
n = 01
m = 02 to 07
Oper
ation
is
re
su
med.
(to
f
o
rw
ard
pa
ge)
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