- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄1971 > UPD78F1146AF1-AN1-A (Renesas Electronics America)MCU 16BIT 78K0R/KX3 64-FBGA PDF資料下載
參數(shù)資料
| 型號(hào)： | UPD78F1146AF1-AN1-A |
| 廠商： | Renesas Electronics America |
| 文件頁(yè)數(shù)： | 409/880頁(yè) |
| 文件大小： | 0K |
| 描述： | MCU 16BIT 78K0R/KX3 64-FBGA |
| 標(biāo)準(zhǔn)包裝： | 300 |
| 系列： | 78K0R/Kx3 |
| 核心處理器： | 78K/0R |
| 芯體尺寸： | 16-位 |
| 速度： | 20MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設(shè)備： | DMA，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 50 |
| 程序存儲(chǔ)器容量： | 256KB（256K x 8） |
| 程序存儲(chǔ)器類(lèi)型： | 閃存 |
| RAM 容量： | 12K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 64-VFBGA |
| 包裝： | 托盤(pán) |
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CHAPTER 11 SERIAL ARRAY UNIT
User’s Manual U17854EJ9V0UD
465
Table 11-4 Operating Clock Selection
SMR02
Register
SPS0 Register
Operation Clock (MCK)
Note 1
CKS02
PRS
013
PRS
012
PRS
011
PRS
010
PRS
003
PRS
002
PRS
001
PRS
000
fCLK = 20 MHz
X
0
fCLK
20 MHz
X
0
1
fCLK/2
10 MHz
X
0
1
0
fCLK/2
2
5 MHz
X
0
1
fCLK/2
3
2.5 MHz
X
0
1
0
fCLK/2
4
1.25 MHz
X
0
1
0
1
fCLK/2
5
625 kHz
X
0
1
0
fCLK/2
6
313 kHz
X
0
1
fCLK/2
7
156 kHz
X
1
0
fCLK/2
8
78.1 kHz
X
1
0
1
fCLK/2
9
39.1 kHz
X
1
0
1
0
fCLK/2
10
19.5 kHz
X
1
0
1
fCLK/2
11
9.77 kHz
0
X
1
INTTM02
Note 2
0
X
fCLK
20 MHz
0
1
X
fCLK/2
10 MHz
0
1
0
X
fCLK/2
2
5 MHz
0
1
X
fCLK/2
3
2.5 MHz
0
1
0
X
fCLK/2
4
1.25 MHz
0
1
0
1
X
fCLK/2
5
625 kHz
0
1
0
X
fCLK/2
6
313 kHz
0
1
X
fCLK/2
7
156 kHz
1
0
X
fCLK/2
8
78.1 kHz
1
0
1
X
fCLK/2
9
39.1 kHz
1
0
1
0
X
fCLK/2
10
19.5 kHz
1
0
1
X
fCLK/2
11
9.77 kHz
1
X
INTTM02
Note 2
Other than above
Setting prohibited
Notes 1. When changing the clock selected for fCLK (by changing the system clock control register
(CKC) value), do so after having stopped (ST0 = 000FH) the operation of the serial array
unit (SAU). When selecting INTTM02 for the operation clock, also stop the timer array unit
(TAU) (TT0 = 00FFH).
2. SAU can be operated at a fixed division ratio of the subsystem clock, regardless of the fCLK
frequency (main system clock, subsystem clock), by operating the interval timer for which
fSUB/4 has been selected as the count clock (setting TIS02 (if m = 0) or TIS03 (if m = 1) of
the TIS0 register to 1) and selecting INTTM02 and INTTM03 by using the SPSm register in
channels 2 and 3 of TAU. When changing fCLK, however, SAU and TAU must be stopped as
described in Note 1 above.
Remark
X: Don’t care
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