參數(shù)資料
型號： UPD78F0397DGC(T)-8EU-A
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, LEAD FREE, FINE PITCH, PLASTIC, LQFP-100
文件頁數(shù)： 170/321頁
文件大?。?/td> 4156K
代理商： UPD78F0397DGC(T)-8EU-A
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CHAPTER 13 LCD CONTROLLER/DRIVER
User’s Manual U15075EJ1V0UM00
251
(2)
LCD clock control register 0 (LCDC0)
LCDC0 specifies the LCD clock and frame frequency.
LCDC0 is set with a 1-bit or 8-bit memory manipulation instruction.
RESET input sets LCDC0 to 00H.
Figure 13-3. Format of LCD Clock Control Register 0
LCDC03 LCDC02 LCDC01 LCDC00
LCDC0
Symbol
Address
After reset
R/W
FFB2H
00H
R/W
76543210
Internal clock (fLCD) selectionNote
LCDC03
0
1
LCDC02
0
1
0
1
LCD clock (LCDCL) selection
LCDC01
0
1
LCDC00
0
1
0
1
0000
fLCD/26
fLCD/27
fLCD/28
fLCD/29
fXT
(32.768 kHz)
fX/25 (156.3 kHz)
fX/26 (78.1 kHz)
fX/27 (39.1 kHz)
Note
Specify an internal clock (fLCD) frequency of at least 32 kHz.
Cautions 1. Bits 4 to 7 must be set to 0.
2. Before changing the LCDC0 setting, be sure to stop voltage amplification (VAON0 = 0).
3. Set the frame frequency to 128 Hz or lower.
Remarks 1. fX:
Main system clock oscillation frequency
2. fXT:
Subsystem clock oscillation frequency
3. The parenthesized values apply to operation at fX = 5.0 MHz or fXT = 32.768 kHz.
Table 13-3 lists the frame frequencies used when fXT (32.768 kHz) is supplied to the internal clock (fCLK1).
Table 13-3. Frame Frequencies (Hz)
LCD Clock (fLCD)
Display Duty Ratio
fXT/2
9
(64 Hz)
fXT/2
8
(128 Hz)
fXT/2
7
(256 Hz)
fXT/2
6
(512 Hz)
1/3
21
43
85
171
Note
1/4
16
32
64
128
Note
This setting is prohibited because it causes the frame frequency to exceed 128 Hz.
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