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參數(shù)資料
| 型號： | UPD784021 |
| 廠商： | NEC Corp. |
| 英文描述： | 16/8-BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 16/8-BIT單片機 |
| 文件頁數(shù)： | 69/90頁 |
| 文件大?。?/td> | 614K |
| 代理商： | UPD784021 |
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69
m
PD784020, 784021
SERIAL OPERATION (IOE1, IOE2)
Remarks 1.
The values listed in the above table are obtained when C
L
= 100 pF.
2.
T: Serial clock frequency specified using software. The minimum value is 16/f
XX
.
SERIAL OPERATION (UART, UART2)
Unit
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Min.
250
500
T
85
210
0.5T – 40
85
210
0.5T – 40
40
40
0
0.5T
CYSK1
– 40
Max.
50
Conditions
Input
V
DD
= +5.0 V
±
10 %
Output
Internal clock divided by 16
Input
V
DD
= +5.0 V
±
10 %
Output
Internal clock divided by 16
Input
V
DD
= +5.0 V
±
10 %
Output
Internal clock divided by 16
During data transfer
Symbol
t
CYSK1
t
WSKL1
t
WSKH1
t
SSSK1
t
HSSK1
t
DSOSK
t
HSOSK
Parameter
Serial clock cycle time
(SCK1, SCK2)
Serial clock low-level width
(SCK1, SCK2)
Serial clock high-level width
(SCK1, SCK2)
SI1, SI2 setup time
(referred to SCK1, SCK2
)
SI1, SI2 hold time
(referred to SCK1, SCK2
)
SO1, SO2 output delay time
(referred to SCK1, SCK2
)
SO1, SO2 output hold time
(referred to SCK1, SCK2
)
Parameter
ASCK clock input cycle time
ASCK clock low-level width
ASCK clock high-level width
Symbol
t
CYASK
t
WASKL
t
WASKH
Unit
ns
ns
ns
ns
ns
ns
Min.
125
250
52.5
85
52.5
85
Max.
Conditions
V
DD
= +5.0 V
±
10 %
V
DD
= +5.0 V
±
10 %
V
DD
= +5.0 V
±
10 %
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD784031GC-3B9 | 16/8-BIT SINGLE-CHIP MICROCONTROLLER |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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