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參數(shù)資料
| 型號： | UPD70F3116A1 |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 14/826頁 |
| 文件大?。?/td> | 3455K |
| 代理商： | UPD70F3116A1 |
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14
User’s Manual U14492EJ5V0UD
11.8.6
11.8.7
Error control function ................................................................................................................. 536
Baud rate control function.......................................................................................................... 539
11.9 Cautions on Bit Set/Clear Function.......................................................................................542
11.10 Control Registers....................................................................................................................544
11.11 Operations ...............................................................................................................................596
11.11.1 Initialization processing ............................................................................................................. 596
11.11.2 Transmit setting......................................................................................................................... 609
11.11.3 Receive setting.......................................................................................................................... 610
11.11.4 CAN sleep mode ....................................................................................................................... 612
11.11.5 CAN stop mode......................................................................................................................... 613
11.12 Rules for Correct Setting of Baud Rate ................................................................................615
11.13 Ensuring Data Consistency ...................................................................................................619
11.13.1 Sequential data read ................................................................................................................. 619
11.13.2 Burst read mode........................................................................................................................ 620
11.14 Interrupt Conditions................................................................................................................621
11.14.1 Interrupts that are generated for FCAN controller...................................................................... 621
11.14.2 Interrupts that are generated for global CAN interface.............................................................. 621
11.15 How to Shut Down FCAN Controller.....................................................................................622
11.16 Cautions on Use......................................................................................................................623
CHAPTER 12 NBD FUNCTION (
μ
PD70F3116)...................................................................................625
12.1 Overview ..................................................................................................................................625
12.2 NBD Function Register Map...................................................................................................626
12.3 NBD Function Protocol...........................................................................................................627
12.4 NBD Function ..........................................................................................................................630
12.4.1
RAM monitoring, accessing NBD space.................................................................................... 630
12.4.2
Event detection function ............................................................................................................ 632
12.4.3
Chip ID registers (TID0 to TID2)................................................................................................ 633
12.5 Control Registers....................................................................................................................634
12.6 Restrictions on NBD ...............................................................................................................637
12.6.1
General restrictions ................................................................................................................... 637
12.6.2
Restrictions related to read or write of RAM by NBD................................................................. 637
12.6.3
Restrictions related to NBD event trigger function..................................................................... 637
12.6.4
How to detect termination of DMA initialization via NBD tool..................................................... 637
12.7 Initialization Required for DMA (2 Channels).......................................................................638
CHAPTER 13 A/D CONVERTER ..........................................................................................................642
13.1 Features ...................................................................................................................................642
13.2 Configuration...........................................................................................................................642
13.3 Control Registers....................................................................................................................646
13.4 Interrupt Requests ..................................................................................................................655
13.5 A/D Converter Operation........................................................................................................656
13.5.1
A/D converter basic operation ................................................................................................... 656
13.5.2
Operation modes and trigger modes ......................................................................................... 657
13.6 Operation in A/D Trigger Mode..............................................................................................660
13.6.1
Operation in select mode........................................................................................................... 660
13.6.2
Operation in scan mode ............................................................................................................ 661
13.7 Operation in A/D Trigger Polling Mode.................................................................................662
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