參數(shù)資料
型號(hào)： TSX88915TMW100
廠商： E2V TECHNOLOGIES PLC
元件分類(lèi)： 時(shí)鐘及定時(shí)
英文描述： PLL BASED CLOCK DRIVER, 7 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), CQCC28
封裝： CERAMIC, LCC-28
文件頁(yè)數(shù)： 19/20頁(yè)
文件大?。?/td> 168K
代理商： TSX88915TMW100
TS88915T
8/20
4.2.2. Capacitance and power specifications
Symbol
Parameter
Typical values
Unit
Conditions
CIN
Input Capacitance
10
pF
VCC = 5.0 V
CPD
Power Dissipation Capacitance
40
pF
VCC = 5.0 V
PD1
Power Dissipation @ 50 MHz with 50
W Thevenin Termina-
tion
23mW/Output
184mW/Device
mW
VCC = 5.0 V
T = 25
°C
PD2
Power Dissipation @ 50 MHz with 50
W Parallel Termination
to GND
57mW/Output
456mW/Device
mW
VCC = 5.0 V
T = 25
°C
Note :
PD1 and PD2 mW/Output are for a ’Q’ output.
4.3. Dynamic characteristics (Tc=-55° C to +125° C, VCC = 5.0 V $ 5%)
4.3.1. Frequency specifications
Symbol
Parameter
Guaranteed Minimum
Unit
Symbol
Parameter
88915T–70
88915T–100
Unit
fmax 1
Maximum Operating Frequency (2X_Q Output)
70
100
MHz
Maximum Operating Frequency (Q0–Q4, Q5 Out-
puts)
35
50
MHz
Note 1 : Maximum Operating Frequency is guaranteed with the part in a phase–locked condition, and all outputs loaded with 50
W
terminated to VCC/2.
4.3.2. SYNC input timing requirements
Symbol
Parameter
Minimum
Maxim m Unit
Symbol
Parameter
88915T–70
88915T–100
Maximum Unit
tRISE/FALL, SYNC Inputs Rise/Fall Time, SYNC Inputs
From 0.8 to 2.0 V
–
3.0
ns
tCYCLE, SYNC Inputs
Input Clock Period, SYNC Inputs
28.5 1
20.0 1
200 2
ns
Duty Cycle SYNC
Inputs
Input Duty Cycle, SYNC Inputs
50 %
$ 25 %
Note 1 : These tCYCLE minimum values are valid when ’Q’ output is fed back and connected to the FEEDBACK pin.
Note 2 : Information in Table 1 and in Note 3 of the AC specification notes describe this specification and its limits depending on what
output is fed back, and if FREQ_SEL is high or low.
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