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參數(shù)資料
| 型號(hào)： | TMX320C6413GTS |
| 廠商： | Texas Instruments, Inc. |
| 元件分類(lèi)： | 數(shù)字信號(hào)處理 |
| 英文描述： | Fixed-Point Digital Signal Processors |
| 中文描述： | 定點(diǎn)數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 61/140頁(yè) |
| 文件大?。?/td> | 1958K |
| 代理商： | TMX320C6413GTS |
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Terminal Functions
61
April 2004
Revised May 2005
SPRS247E
Table 3
9. Terminal Functions (Continued)
NAME
DESCRIPTION
IPD/
IPU
TYPE
NO.
MULTICHANNEL BUFFERED SERIAL PORT 1 (McBSP1)
I/O/Z
IPD
McBSP1 receive clock
I/O/Z
IPD
McBSP1 receive frame sync
I
IPD
McBSP1 receive data
I
IPD
McBSP1 external clock source (as opposed to internal)
O/Z
IPD
McBSP1 transmit data
I/O/Z
IPD
McBSP1 transmit frame sync
I/O/Z
IPD
McBSP1 transmit clock
MULTICHANNEL BUFFERED SERIAL PORT 0 (McBSP0)
I/O/Z
IPD
McBSP0 receive clock
I/O/Z
IPD
McBSP0 receive frame sync
I
IPD
McBSP0 receive data
I
IPD
McBSP0 external clock source (as opposed to internal)
O/Z
IPD
McBSP0 transmit data
I/O/Z
IPD
McBSP0 transmit frame sync
I/O/Z
IPD
McBSP0 transmit clock
MULTICHANNEL AUDIO SERIAL PORT 0 (McASP0)
I/O/Z
IPD
McASP0 transmit high-frequency master clock.
I/O/Z
IPD
McASP0 transmit frame sync or left/right clock (LRCLK).
I/O/Z
IPD
McASP0 transmit bit clock.
I/O/Z
IPD
McASP0 mute output.
I
IPD
McASP0 mute input.
I/O/Z
IPD
McASP0 receive high-frequency master clock.
I/O/Z
IPD
McASP0 receive frame sync or left/right clock (LRCLK).
I/O/Z
IPD
McASP0 receive bit clock.
McASP0 TX/RX data pin [5].
McASP0 TX/RX data pin [4].
McASP0 TX/RX data pins [3].
McASP0 TX/RX data pin [2].
McASP0 TX/RX data pin [1].
McASP0 TX/RX data pins[0].
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog Signal
IPD = Internal pulldown, IPU = Internal pullup. (These IPD/IPU signal pins feature a 30-k
IPD or IPU resistor. To pull up a signal to the opposite
supply rail, a 1-k
resistor should be used.)
§
These pins are multiplexed pins. For more details, see the Device Configurations section of this data sheet.
CLKR1
FSR1
DR1
CLKS1
DX1
FSX1
CLKX1
G3
G2
F1
G1
H2
H3
H1
CLKR0
FSR0
DR0
CLKS0
DX0
FSX0
CLKX0
C2
D1
D2
D3
E2
E4
E3
AHCLKX0
AFSX0
ACLKX0
AMUTE0
AMUTEIN0
AHCLKR0
AFSR0
ACLKR0
AXR0[5]
AXR0[4]
AXR0[3]
AXR0[2]
AXR0[1]
AXR0[0]
N1
M2
M1
K4
J4
L1
K2
K1
P3
N3
M3
L3
K3
L2
I/O/Z
IPD
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