TMS320C6211, TMS320C6211B
FIXED-POINT DIGITAL SIGNAL PROCESSORS
SPRS073K
AUGUST 1998
REVISED MARCH 2004
2
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
1443
Table of Contents
absolute maximum ratings over operating case
temperature range
recommended operating conditions
electrical characteristics over recommended ranges of
supply voltage and operating case temperature
parameter measurement information
signal transition levels
. . . . . . . . . . . . . . . . . . . . . . . . . .
timing parameters and board routing analysis
input and output clocks
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asynchronous memory timing
synchronous-burst memory timing
synchronous DRAM timing
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HOLD/HOLDA timing
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BUSREQ timing
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reset timing
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external interrupt timing
. . . . . . . . . . . . . . . . . . . . . . . . . .
host-port interface timing
. . . . . . . . . . . . . . . . . . . . . . . . .
multichannel buffered serial port timing
timer timing
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JTAG test-port timing
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mechanical data
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revision history
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40
40
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41
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GFN BGA package (bottom view)
description
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device characteristics
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device compatibility
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functional block and CPU (DSP core) diagram
CPU (DSP core) description
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memory map summary
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
peripheral register descriptions
PWRD bits in CPU CSR register description
EDMA channel synchronization events
interrupt sources and interrupt selector
signal groups description
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
terminal functions
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development support
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documentation support
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clock PLL
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power-down logic
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power-supply sequencing
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IEEE 1149.1 JTAG compatibility statement
EMIF device speed
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bootmode
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GFN BGA package (bottom view)
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GFN 256-PIN BALL GRID ARRAY (BGA) PACKAGE
(BOTTOM VIEW)