- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄382643 > TMS370CX5X (Texas Instruments, Inc.) 8-BIT MICROCONTROLLER PDF資料下載
參數(shù)資料
| 型號： | TMS370CX5X |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-BIT MICROCONTROLLER |
| 中文描述： | 8位微控制器 |
| 文件頁數(shù)： | 44/54頁 |
| 文件大小： | 785K |
| 代理商： | TMS370CX5X |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁當(dāng)前第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁
TMS370Cx9x
8-BIT MICROCONTROLLER
SPNS036B – JANUARY 1996 – REVISED FEBRUARY 1997
44
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
external clocking requirements for clock divided by 4
(see Figure 19)
NO.
PARAMETER
MIN
MAX
UNIT
1
tw(Cl)
tr(Cl)
tf(CI)
td(CIH-SCL)
CLKIN
Pulse duration, XTAL2/CLKIN (see Note 9)
20
ns
2
Rise time, XTAL2/CLKIN
30
ns
3
Fall time, XTAL2/CLKIN
30
ns
4
Delay time, XTAL2/CLKIN rise to SYSCLK fall
100
ns
Crystal operating frequency
System clock
2
20
MHz
SYSCLK
0.5
5
MHz
For VIL and VIH, refer to recommended operating conditions.
SYSCLK = CLKIN/4
NOTE 9: This pulse can be either a high pulse, which extends from the earliest valid high to the final valid high in an XTAL2/CLKIN cycle or a
low pulse, which extends from the earliest valid low to the final valid low in an XTAL2/CLKIN cycle.
XTAL2/CLKIN
3
2
1
4
SYSCLK
Figure 19. External Clock Timing for Divide-by-4
external clocking requirements for clock divided by 1 (PLL)
(see Figure 20)
NO.
1
PARAMETER
MIN
20
MAX
UNIT
ns
tw(Cl)
tr(Cl)
tf(CI)
td(CIH-SCH)
CLKIN
Pulse duration, XTAL2/CLKIN (see Note 9)
2
Rise time, XTAL2/CLKIN
30
ns
3
Fall time, XTAL2/CLKIN
30
ns
4
Delay time, XTAL2/CLKIN rise to SYSCLK rise
100
ns
Crystal operating frequency
System clock§
2
5
MHz
SYSCLK
2
5
MHz
For VIL and VIH, refer to recommended operating conditions.
§SYSCLK = CLKIN/1
NOTE 9: This pulse can be either a high pulse, which extends from the earliest valid high to the final valid high in an XTAL2/CLKIN cycle or a
low pulse, which extends from the earliest valid low to the final valid low in an XTAL2/CLKIN cycle.
XTAL2/CLKIN
3
2
1
4
SYSCLK
Figure 20. External Clock Timing for Divide-by-1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TMS370CX6X | 8-BIT MICROCONTROLLER |
| TMS370CX7X | 8-BIT MICROCONTROLLER |
| TMS370CX8X | 8-BIT MICROCONTROLLER |
| TMS370CX9X | 8-BIT MICROCONTROLLER |
| TMS370C311A | 8-BIT MICROCONTROLLER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TMS370P16A27FNQ | 制造商:Texas Instruments 功能描述: |
| TMS37112B3 WAF | 制造商:Texas Instruments 功能描述: |
| TMS37122DPWRG4 | 制造商:Texas Instruments 功能描述:3D Analog Front-end, TITL |
| TMS37145TEAIE | 制造商:Texas Instruments 功能描述: |
| TMS37145TEAIEG | 制造商:Texas Instruments 功能描述: |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。