參數(shù)資料
型號： TMS320LF2404A
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： DSP CONTROLLERS
中文描述： DSP控制器
文件頁數(shù)： 109/132頁
文件大?。?/td> 1660K
代理商： TMS320LF2404A
SPRS145J JULY 2000 REVISED NOVEMBER 2004
109
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
10-bit analog-to-digital converter (ADC) (continued)
internal ADC module timing
(see Figure 51)
MIN
MAX
UNIT
tc(AD)
Cycle time, ADC prescaled clock
Pulse duration, total sample/hold and
conversion time
Delay time, start of conversion to beginning of sample and hold
33.3
ns
tw(SHC)
500
ns
td(SOC-SH)
tw(SH)
tw(C)
td(EOC)
td(ADCINT)
The ADC timing diagram represents a typical conversion sequence. See the ADC chapter in the
TMS320LF/LC240xA DSP Controllers Reference
Guide: System and Peripherals
(literature number SPRU357) for more details.
The total sample/hold and conversion time is determined by the summation of td(SOC-SH), tw(SH), tw(C), and td(EOC).
§Can be varied by ACQ Prescaler bits in the ADCTRL1 register
2tc(CO)
2tc(AD)§
10tc(AD)
2tc(CO)
2tc(CO)
ns
Pulse duration, sample and hold time
32tc(AD)
ns
Pulse duration, total conversion time
ns
Delay time, end of conversion to data loaded into result register
ns
Delay time, ADC flag to ADC interrupt
ns
0
3
2
4
5
1
tw(C)
6
7
8
tc(AD)
ADC Clock
Analog Input
Bit Converted
td(SOCSH)
EOC/Convert
Internal Start/
Sample Hold
Start of Convert
XFR to RESULTn
tw(SHC)
á
á
á
á
td(EOC)
9
tw(SH)
td(ADCINT)
ADC Interrupt
Figure 51. Analog-to-Digital Internal Module Timing
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