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參數(shù)資料
| 型號(hào)： | TMP320LF2401APAGA |
| 廠(chǎng)商： | Texas Instruments, Inc. |
| 元件分類(lèi)： | 數(shù)字信號(hào)處理 |
| 英文描述： | DSP CONTROLLERS |
| 中文描述： | DSP控制器 |
| 文件頁(yè)數(shù)： | 84/134頁(yè) |
| 文件大?。?/td> | 1759K |
| 代理商： | TMP320LF2401APAGA |
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TMS320LF2407A, TMS320LF2406A, TMS320LF2403A, TMS320LF2402A
TMS320LC2406A, TMS320LC2404A, TMS320LC2403A, TMS320LC2402A
DSP CONTROLLERS
SPRS145K
JULY 2000
REVISED AUGUST 2005
84
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
1443
low-power mode timing
switching characteristics over recommended operating conditions [H = 0.5t
c(CO)
]
(see Figure 30, Figure 31, and Figure 32)
PARAMETER
LOW-POWER MODES
MIN
TYP
12
×
t
c(CO)
15
×
t
c(CO)
MAX
UNIT
t
d(WAKE-A)
Delay time, CLKOUT switching to
program execution resume
IDLE1
LPM0
ns
IDLE2
LPM1
t
d(IDLE-COH)
Delay time, Idle instruction executed to
CLKOUT high
IDLE2
LPM1
4t
c(CO)
ns
t
d(WAKE-OSC)
Delay time, wakeup interrupt
asserted to oscillator running
HALT
{PLL/OSC power down}
LPM2
OSC start-up
time
ms
t
d(IDLE-OSC)
Delay time, Idle instruction executed to
oscillator power off
4t
c(CO)
ns
t
d(EX)
Delay time, reset vector executed after PLL lock time
36H
ns
WAKE INT
CLKOUT
A0
A15
t
d(WAKE
A)
WAKE INT can be any valid interrupt or RESET.
Figure 30. IDLE1 Entry and Exit Timing
LPM0
t
d(WAKE
A)
t
d(IDLE
COH)
WAKE INT
CLKOUT
A0
A15
WAKE INT can be any valid interrupt or RESET.
Figure 31. IDLE2 Entry and Exit Timing
LPM1
t
d(EX)
t
d(IDLE
COH)
t
d(IDLE
OSC)
RESET
CLKOUT
A0
A15
t
d(WAKE
OSC)
t
w(RSL)
t
p
Figure 32. HALT Mode
LPM2
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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