參數(shù)資料
型號： TC7MPH3125FTG
廠商： Toshiba Corporation
英文描述： Low Voltage/Low Power 2-Bit 】 2 Dual Supply Bus Transceiver with Bushold
中文描述： 低電壓/低功率2位】2雙與Bushold電源總線收發(fā)器
文件頁數(shù)： 14/23頁
文件大?。?/td> 348K
代理商： TC7MPH3125FTG
TC7MPH3125FK/FTG
2007-10-19
14
AC Characteristics
(Ta
=
40 to 85°C, Input: t
r
=
t
f
=
2.0 ns)
V
CCA
=
2.5
±
0.2 V, V
CCB
=
3.3
±
0.3 V
Characteristics
Symbol
Test Condition
Min
Max
Unit
Propagation delay time
(Bn
→
An)
t
pLH
t
pHL
Figure 1, Figure 2
1.0
5.4
3-state output enable time
(OE
→
An)
t
pZL
t
pZH
Figure 1, Figure 3
1.0
8.4
3-state output disable time
(
OE
→
An)
t
pLZ
t
pHZ
Figure 1, Figure 3
1.0
6.7
ns
Propagation delay time
(An
→
Bn)
t
pLH
t
pHL
Figure 1, Figure 2
1.0
6.8
3-state output enable time
(
OE
→
Bn)
t
pZL
t
pZH
Figure 1, Figure 3
1.0
8.7
3-state output disable time
(OE
→
Bn)
t
pLZ
t
pHZ
Figure 1, Figure 3
1.0
3.9
ns
Output to output skew
t
osLH
t
osHL
(Note)
0.5
ns
Note: Parameter guaranteed by design.
(t
osLH
=
|t
pLHm
t
pLHn
|, t
osHL
=
|t
pHLm
t
pHLn
|)
V
CCA
=
1.8
±
0.15 V, V
CCB
=
3.3
±
0.3 V
Characteristics
Symbol
Test Condition
Min
Max
Unit
Propagation delay time
(Bn
→
An)
t
pLH
t
pHL
Figure 1, Figure 2
1.0
8.9
3-state output enable time
(OE
→
An)
t
pZL
t
pZH
Figure 1, Figure 3
1.0
13.4
3-state output disable time
(OE
→
An)
t
pLZ
t
pHZ
Figure 1, Figure 3
1.0
10.9
ns
Propagation delay time
(An
→
Bn)
t
pLH
t
pHL
Figure 1, Figure 2
1.0
7.8
3-state output enable time
(OE
→
Bn)
t
pZL
t
pZH
Figure 1, Figure 3
1.0
10.7
3-state output disable time
(OE
→
Bn)
t
pLZ
t
pHZ
Figure 1, Figure 3
1.0
5.2
ns
Output to output skew
t
osLH
t
osHL
(Note)
0.5
ns
Note: Parameter guaranteed by design.
(t
osLH
=
|t
pLHm
t
pLHn
|, t
osHL
=
|t
pHLm
t
pHLn
|)
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PDF描述
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TC7MPN3245FTG 功能描述:總線收發(fā)器 Bus Trancvr Lo-Noise 8-Bit Bidirectional RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel
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