Precision Edge SY100S839V Micrel, Inc. M9999-032206 hbwhelp@micrel.com or (408) 955-1690
參數(shù)資料
型號(hào)： SY100S839VZC TR
廠商： Micrel Inc
文件頁數(shù)： 4/6頁
文件大?。?/td> 0K
描述： IC CLOCK GEN 3.3V/5V 20-SOIC
標(biāo)準(zhǔn)包裝： 1,000
系列： Precision Edge®
類型： 時(shí)鐘發(fā)生器
PLL： 無
輸入： ECL，LVECL，LVPECL，PECL
輸出： 時(shí)鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:4
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1GHz
除法器/乘法器： 是/無
電源電壓： 3 V ~ 5.5 V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 20-SOIC（寬型）
包裝： 帶卷 (TR)
其它名稱： SY100S839VZCTR
SY100S839VZCTR-ND
4
Precision Edge
SY100S839V
Micrel, Inc.
M9999-032206
hbwhelp@micrel.com or (408) 955-1690
TA = –40
°CTA = 0°CTA = +25°CTA = +85°C
Symbol
Parameter
Min.
Typ. Max. Min.
Typ. Max.
Unit
fMAX
Maximum Toggle Frequency
1000
—
1000
—
1000
—
1000
—
MHz
tPD
Propagation Delay to Output
ps
CLK Output (Diff.)
725
—
925
725
—
925
725
—
925
725
—
925
CLK Output (S.E.)
675
—
975
675
—
975
675
—
975
675
—
975
MR Output
600
—
900
600
—
900
610
—
910
630
—
930
tskew
Within-Device Skew(2) Q0 — Q3
——
50
——
50
——
50
——
50
ps
Part-to-Part
Q0 — Q3 (Diff.)
—
200
—
200
—
200
—
200
tS
Set-up Time
/EN /CLK
250
—
250
—
250
—
250
—
ps
DIVSEL CLK
400
—
400
—
400
—
400
—
tH
Hold Time
/CLK /EN
100
—
100
—
100
—
100
—
ps
CLK DIVSEL
150
—
150
—
150
—
150
—
VPP
Minimum Input Swing(3)
CLK
250
—
250
—
250
—
250
—
mV
VCMR
Common Mode Range(4), (5)
-1.6
—
-0.4
-1.7
—
-0.4
-1.7
—
-0.4
-1.7
—
-0.4
V
tRR
Reset Recovery Time
—
100
—
100
—
100
—
100
ps
tPW
Minimum Pulse Width
CLK
500
—
500
—
500
—
500
—
ps
MR
700
—
700
—
700
—
700
—
tr
Output Rise/Fall Times
Q
280
—
550
280
—
550
280
—
550
280
—
550
ps
tf
(20% —80%)
AC ELECTRICAL CHARACTERISTICS(1)
VEE = VEE (min) to VEE (max); VCC = GND
Notes:
1. Parametric values specified at:
-3.0V to -3.8V or -4.2V to -5.5V.
2. Skew is measured between outputs under identical transitions.
3. Minimum input swing for which AC parameters are guaranteed. The device will function reliably with differential inputs down to 100mV.
4. The CMR range is referenced to the most positive side of the differential input signal. Normal operation is obtained if the HIGH level falls within the specified
range and the peak-to-peak voltage lies between VPP min. and 1V. The lower end of the CMR range varies 1:1 with VEE. The numbers in the spec table
assume a nominal VEE = –3.3V. Note for PECL operation, the VCMR (min) will be fixed at 3.3V – IVCMR (min)I.
5. Duty Cycle: (Min. 48%; Max. 52%) } over temp.
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PDF描述
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SY100S839VZC IC CLOCK GEN 3.3V/5V 20-SOIC
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參數(shù)描述
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