參數(shù)資料
型號： STD111
英文描述： STD111|Data Sheet
中文描述： STD111 |數(shù)據(jù)資料
文件頁數(shù)： 16/862頁
文件大?。?/td> 3072K
代理商： STD111
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Introduction
1.1 Library Description
SEC ASIC
1-1
STD110
1.1
Library
Description
SEC ASIC offers STD110 as 0.25um CMOS standard cell library. SEC's 0.25um
cell-based logic process providing up to 5 layers of interconnect metal with
various I/O pad-pitch options such as 70um pitch pad and 80um pitch pad.
STD110 which reduced power dissipation and system cost by merging the logic
and IPs as a whole and connecting internally from logic to memory data bus is
ideal for high-performance products such as graphics controller, projector,
portable CD and so on.
STD110 can support up to eight million gate counts of logic providing 75% of
usable gate. STD110 is 25% faster than 0.35um library MDL90. Logic density is
2.3 times greater than that of MDL90. The power consumption of compiled
memory is 90% smaller than MDL90.
STD110 also supports fully user-configurable compiled memory and datapath
elements. Each element is provided as a compiler. Two different types of
compiled memories in STD110 are available to support memories suitable to
high-density and low-power applications.
To support mixed voltage environments, 2.5V, 3.3V drive and 5V-tolerant IO cells
are available. LVTTL, LVCMOS, PCI, OSC, AGP, PECL, HSTL, LVDS and USB
buffers are supported. To better support a system-on-chip design style, various
core cells are available including processor cores like ARM7TDMI/ARM9TDMI/
ARM920T/ARM940T from ARM, Teaklite and Oak from DSPG.
The STD110 supports data transmission and communication core such as USB,
IEEE1284 and UART.
The list of analog core cells includes ADC, DAC, CODEC, LVDS, RAMDAC and
PLL with various bits and frequency ranges.
SEC design methodology offers an comprehensive timing driven design flow
including automated time budgeting, tight floorplan synthesis intergration,
powerful timing analysis and timing driven layout. Its advanced characterization
flow provides accurate timing data and robust delay models for a 0.25um very
deep-submicron technology. Advanced verification methods like static timing
analysis and formal verification provide an effective verification methodology with
a variety of simulators and cycle based simulation. SEC DFT methodology
supports scan design, BIST and JTAG boundary scan. SEC provides a full set of
test-ready IPs with an efficient core test integration methodology.
相關(guān)PDF資料
PDF描述
STD12N05-1 TRANSISTOR | MOSFET | N-CHANNEL | 50V V(BR)DSS | 12A I(D) | TO-251
STD12NF06T4 TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 12A I(D) | TO-252AA
STD12N05L-1 TRANSISTOR | MOSFET | N-CHANNEL | 50V V(BR)DSS | 12A I(D) | TO-251
STD12N05LT4 TRANSISTOR | MOSFET | N-CHANNEL | 50V V(BR)DSS | 12A I(D) | TO-252
STD12N05T4 TRANSISTOR | MOSFET | N-CHANNEL | 50V V(BR)DSS | 12A I(D) | TO-252
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
STD116 制造商:SIRECTIFIER 制造商全稱:Sirectifier Semiconductors 功能描述:Thyristor-Diode Modules, Diode-Thyristor Modules
STD116GK08 制造商:SIRECT 制造商全稱:Sirectifier Global Corp. 功能描述:Thyristor-Diode Modules, Diode-Thyristor Modules
STD116GK12 制造商:SIRECT 制造商全稱:Sirectifier Global Corp. 功能描述:Thyristor-Diode Modules, Diode-Thyristor Modules
STD116GK14 制造商:SIRECT 制造商全稱:Sirectifier Global Corp. 功能描述:Thyristor-Diode Modules, Diode-Thyristor Modules
STD116GK16 制造商:SIRECTIFIER 制造商全稱:Sirectifier Semiconductors 功能描述:Thyristor-Diode Modules, Diode-Thyristor Modules
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