參數(shù)資料
型號(hào)： ST72F324J2
英文描述： 8-BIT MCU WITH NESTED INTERRUPTS. FLASH. 10-BIT ADC. 4 TIMERS. SPI. SCI INTERFACE
中文描述： 8位微控制器嵌套中斷。閃光。 10位ADC。 4定時(shí)器。的SPI。 SCI接口
文件頁數(shù)： 22/161頁
文件大?。?/td> 2070K
代理商： ST72F324J2
ST72324
118/161
12.3.4 Auxiliary Voltage Detector (AVD) Thresholds
Subject to general operating conditions for VDD, fCPU, and TA.
1. Data based on characterization results, not tested in production.
2. Applicable only in low voltage devices (planned).
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIT+(AVD)
1
0 AVDF flag toggle threshold
(VDD rise)
VD level = High in option byte
4.41)
4.6
4.9
V
VD level = Med. in option byte2)
VD level = Low in option byte2)
3.95 1)
3.4 1)
4.15
3.6
4.4
3.8
VIT-(AVD)
0
1 AVDF flag toggle threshold
(VDD fall)
VD level = High in option byte
4.2
4.4
4.65 1)
VD level = Med. in option byte2)
VD level = Low in option byte2)
3.75
3.2
4.0
3.4
4.2 1)
3.6 1)
Vhys(AVD)
AVD voltage threshold hysteresis
VIT+(AVD)-VIT-(AVD)
200
mV
V
IT-
Voltage drop between AVD flag set
and LVD reset activated
VIT-(AVD)-VIT-(LVD)
450
mV
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PDF描述
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ST72F324J6 8-BIT MCU WITH NESTED INTERRUPTS. FLASH. 10-BIT ADC. 4 TIMERS. SPI. SCI INTERFACE
ST72F324K2 8-BIT MCU WITH NESTED INTERRUPTS. FLASH. 10-BIT ADC. 4 TIMERS. SPI. SCI INTERFACE
ST72F324K4 64Mb EDO/FPM - OBSOLETE
ST72F324K6 64Mb EDO/FPM - OBSOLETE
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