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參數(shù)資料
| 型號： | ST72F321AR7T6 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 64/44-PIN 8-BIT MCU WITH 32 TO 60K FLASH/ROM, ADC, FIVE TIMERS, SPI, SCI, I2C INTERFACE |
| 中文描述： | 64/44-PIN 8位微控制器32點(diǎn)，至60,000閃存/ ROM，ADC的，5個定時器，SPI和SCI的I2C接口 |
| 文件頁數(shù)： | 126/189頁 |
| 文件大?。?/td> | 3090K |
| 代理商： | ST72F321AR7T6 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁當(dāng)前第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁
ST72321
126/189
I
2
C BUS INTERFACE
(Cont’d)
I
2
C OWN ADDRESS REGISTER (OAR1)
Read / Write
Reset Value: 0000 0000 (00h)
7-bit Addressing Mode
Bit 7:1 =
ADD[7:1]
Interface address
.
These bits define the I
2
C bus address of the inter-
face. They are not cleared when the interface is
disabled (PE=0).
Bit 0 =
ADD0
Address direction bit.
This bit is don’t care, the interface acknowledges
either 0 or 1. It is not cleared when the interface is
disabled (PE=0).
Note: Address 01h is always ignored.
10-bit Addressing Mode
Bit 7:0 =
ADD[7:0]
Interface address
.
These are the least significant bits of the I
2
C bus
address of the interface. They are not cleared
when the interface is disabled (PE=0).
I
2
C OWN ADDRESS REGISTER (OAR2)
Read / Write
Reset Value: 0100 0000 (40h)
Bit 7:6 =
FR[1:0]
Frequency bits.
These bits are set by software only when the inter-
face is disabled (PE=0). To configure the interface
to I
2
C specified delays select the value corre-
sponding to the microcontroller frequency F
CPU
.
f
CPU
< 6 MHz
6 to 8 MHz
Bit 5:3 = Reserved
Bit 2:1 =
ADD[9:8]
Interface address
.
These are the most significant bits of the I
2
C bus
address of the interface (10-bit mode only). They
are not cleared when the interface is disabled
(PE=0).
Bit 0 = Reserved.
7
0
ADD7
ADD6
ADD5
ADD4
ADD3
ADD2
ADD1
ADD0
7
0
FR1
FR0
0
0
0
ADD9
ADD8
0
FR1
0
0
FR0
0
1
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PDF描述 |
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