參數(shù)資料
型號(hào)： ST72C314N4
元件分類： 圖像傳感器
英文描述： CMOS Image Sensor
中文描述： CMOS圖像傳感器
文件頁數(shù)： 75/153頁
文件大?。?/td> 1988K
代理商： ST72C314N4
ST72334J/N, ST72314J/N, ST72124J
28/153
9.2 RESET SEQUENCE MANAGER (RSM)
9.2.1 Introduction
The reset sequence manager includes three RE-
SET sources as shown in Figure 15:
s
External RESET source pulse
s
Internal LVD RESET (Low Voltage Detection)
s
Internal WATCHDOG RESET
These sources act on the RESET pin and it is al-
ways kept low during the delay phase.
The RESET service routine vector is fixed at ad-
dresses FFFEh-FFFFh in the ST7 memory map.
The basic RESET sequence consists of 3 phases
as shown in Figure 14:
s
Delay depending on the RESET source
s
4096 CPU clock cycle delay
s
RESET vector fetch
The 4096 CPU clock cycle delay allows the oscil-
lator to stabilise and ensures that recovery has
taken place from the Reset state.
The RESET vector fetch phase duration is 2 clock
cycles.
Figure 14. RESET Sequence Phases
Figure 15. Reset Block Diagram
RESET
DELAY
INTERNAL RESET
4096 CLOCK CYCLES
FETCH
VECTOR
fCPU
COU
N
T
E
R
RESET
RON
VDD
WATCHDOG RESET
LVD RESET
INTERNAL
RESET
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