- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄383839 > ST72521BR9 ST72521B - 80/64-PIN 8-BIT MCU WITH 32 TO 60K ROM. FIVE TIMERS. SPI. SCI. I2C. CAN INTERFACE PDF資料下載
參數(shù)資料
| 型號： | ST72521BR9 |
| 英文描述： | ST72521B - 80/64-PIN 8-BIT MCU WITH 32 TO 60K ROM. FIVE TIMERS. SPI. SCI. I2C. CAN INTERFACE |
| 中文描述： | ST72521B - 80/64-PIN 8位32至60,000 ROM的微處理器。 5個定時器。的SPI。脊髓損傷。 I2C總線。 CAN接口 |
| 文件頁數(shù)： | 35/198頁 |
| 文件大?。?/td> | 2504K |
| 代理商： | ST72521BR9 |
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ST72521B
35/198
INTERRUPTS
(Cont’d)
Table 6. Interrupt Mapping
Notes:
1. Valid for HALT and ACTIVE-HALT modes except for the MCC/RTC or CSS interrupt source which exits
from ACTIVE-HALT mode only.
6.6 EXTERNAL INTERRUPTS
6.6.1 I/O Port Interrupt Sensitivity
The external interrupt sensitivity is controlled by
the IPA, IPB and ISxx bits of the EICR register
(
Figure 20
). This control allows to have up to 4 fully
independent external interrupt source sensitivities.
Each external interrupt source can be generated
on four (or five) different events on the pin:
I
Falling edge
I
Rising edge
I
Falling and rising edge
I
Falling edge and low level
I
Rising edge and high level (only for ei0 and ei2)
To guarantee correct functionality, the sensitivity
bits in the EICR register can be modified only
when the I1 and I0 bits of the CC register are both
set to 1 (level 3). This means that interrupts must
be disabled before changing sensitivity.
The pending interrupts are cleared by writing a dif-
ferent value in the ISx[1:0], IPA or IPB bits of the
EICR.
N°
Source
Block
Description
Register
Label
Priority
Order
Exit
from
HALT
1)
Address
Vector
RESET
TRAP
TLI
MCC/RTC
CSS
ei0
ei1
ei2
ei3
CAN
SPI
TIMER A
TIMER B
SCI
AVD
I2C
PWM ART
Reset
Software interrupt
External top level interrupt
Main clock controller time base interrupt
Safe oscillator activation interrupt
External interrupt port A3..0
External interrupt port F2..0
External interrupt port B3..0
External interrupt port B7..4
CAN peripheral interrupts
SPI peripheral interrupts
TIMER A peripheral interrupts
TIMER B peripheral interrupts
SCI Peripheral interrupts
Auxiliary Voltage detector interrupt
I2C Peripheral interrupts
PWM ART overflow interrupt
N/A
yes
no
yes
FFFEh-FFFFh
FFFCh-FFFDh
FFFAh-FFFBh
0
EICR
MCCSR
SICSR
1
Higher
Priority
yes
FFF8h-FFF9h
2
3
4
5
6
7
8
9
N/A
yes
yes
yes
yes
yes
yes
no
no
no
no
no
yes
FFF6h-FFF7h
FFF4h-FFF5h
FFF2h-FFF3h
FFF0h-FFF1h
FFEEh-FFEFh
FFECh-FFEDh
FFEAh-FFEBh
FFE8h-FFE9h
FFE6h-FFE7h
FFE4h-FFE5h
FFE2h-FFE3h
FFE0h-FFE1h
CANISR
SPICSR
TASR
TBSR
SCISR
SICSR
(see periph)
ARTCSR
10
11
12
13
Lower
Priority
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