參數(shù)資料
型號(hào)： SPAKDSP321VL240
廠商： Freescale Semiconductor
文件頁數(shù)： 74/84頁
文件大?。?/td> 0K
描述： IC DSP 24BIT 240MHZ 196-MAPBGA
標(biāo)準(zhǔn)包裝： 2
系列： DSP56K/Symphony
類型： 定點(diǎn)
接口： 主機(jī)接口，SSI，SCI
時(shí)鐘速率： 240MHz
非易失內(nèi)存： ROM（576 B）
芯片上RAM： 576kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.60V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 196-LBGA
供應(yīng)商設(shè)備封裝： 196-MAPBGA（15x15）
包裝： 托盤
DSP56321 Technical Data, Rev. 11
A-12
Freescale Semiconductor
Power Consumption Benchmark
M_DPR0 EQU 17
; DMA Channel Priority Level (low)
M_DPR1 EQU 18
; DMA Channel Priority Level (high)
M_DTM EQU $380000
; DMA Transfer Mode Mask (DTM2-DTM0)
M_DTM0 EQU 19
; DMA Transfer Mode 0
M_DTM1 EQU 20
; DMA Transfer Mode 1
M_DTM2 EQU 21
; DMA Transfer Mode 2
M_DIE EQU 22
; DMA Interrupt Enable bit
M_DE EQU 23
; DMA Channel Enable bit
;
DMA Status Register
M_DTD EQU $3F
; Channel Transfer Done Status MASK (DTD0-DTD5)
M_DTD0 EQU 0
; DMA Channel Transfer Done Status 0
M_DTD1 EQU 1
; DMA Channel Transfer Done Status 1
M_DTD2 EQU 2
; DMA Channel Transfer Done Status 2
M_DTD3 EQU 3
; DMA Channel Transfer Done Status 3
M_DTD4 EQU 4
; DMA Channel Transfer Done Status 4
M_DTD5 EQU 5
; DMA Channel Transfer Done Status 5
M_DACT EQU
8
; DMA Active State
M_DCH EQU
$E00
; DMA Active Channel Mask (DCH0-DCH2)
M_DCH0 EQU
9
; DMA Active Channel 0
M_DCH1 EQU
10
; DMA Active Channel 1
M_DCH2 EQU
11
; DMA Active Channel 2
;------------------------------------------------------------------------
;
EQUATES for Enhanced Filter Co-Processor (EFCOP)
;
;------------------------------------------------------------------------
M_FDIR
EQU
$FFFFB0
; EFCOP Data Input Register
M_FDOR
EQU
$FFFFB1
; EFCOP Data Output Register
M_FKIR
EQU
$FFFFB2
; EFCOP K-Constant Register
M_FCNT
EQU
$FFFFB3
; EFCOP Filter Counter
M_FCSR
EQU
$FFFFB4
; EFCOP Control Status Register
M_FACR
EQU
$FFFFB5
; EFCOP ALU Control Register
M_FDBA
EQU
$FFFFB6
; EFCOP Data Base Address
M_FCBA
EQU
$FFFFB7
; EFCOP Coefficient Base Address
M_FDCH
EQU
$FFFFB8
; EFCOP Decimation/Channel Register
;-----------------------------------------------------------------------
;
EQUATES for Phase Locked Loop (PLL)
;
;----------------------------------------------------------------------
;
Register Addresses Of PLL
M_DMFR
EQU
$FFFFD0
M_DPSC
EQU
$FFFFD0
M_PCTL
EQU
$FFFFD1
; PLL Control Register
;
PLL Control Register
M_MFI
EQU
$F
; Multiplication Factor Intager Bits Mask (MFI0-MFI3)
M_MFN
EQU
$7F0
; Multiplication Factor Bits Mask (MFN0-MFN6)
M_MFD
EQU
$3F800
; Multiplication Factor Bits Mask (MFD0-MFD6)
M_PDF
EQU
$3C0000
; PreDivider Factor Bits Mask (PD0-PD3)
M_CPLM
EQU
22
;
M_MFO
EQU
23
;
M_CDF
EQU
$70
; Division Factor Bits Mask (DF0-DF2)
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PDF描述
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