參數(shù)資料
型號(hào)： SN74LVC10ADBRE4
廠商： TEXAS INSTRUMENTS INC
元件分類： 門(mén)電路
英文描述： LVC/LCX/Z SERIES, TRIPLE 3-INPUT NAND GATE, PDSO14
封裝： GREEN, PLASTIC, SSOP-14
文件頁(yè)數(shù)： 13/19頁(yè)
文件大?。?/td> 721K
代理商： SN74LVC10ADBRE4
www.ti.com
Recommended Operating Conditions
(1)
Electrical Characteristics
SN74LVC10A
TRIPLE 3-INPUT POSITIVE-NAND GATE
SCAS284O – JANUARY 1993 – REVISED JULY 2005
TA = 25°C
–40 TO 85
°C
–40 TO 125
°C
UNIT
MIN
MAX
MIN
MAX
MIN
MAX
Operating
1.65
3.6
1.65
3.6
1.65
3.6
VCC
Supply voltage
V
Data retention only
1.5
VCC = 1.65 V to 1.95 V
0.65
× V
CC
0.65
× V
CC
0.65
× V
CC
High-level input
VIH
VCC = 2.3 V to 2.7 V
1.7
V
voltage
VCC = 2.7 V to 3.6 V
2
VCC = 1.65 V to 1.95 V
0.35
× V
CC
0.35
× V
CC
0.35
× V
CC
Low-level input
VIL
VCC = 2.3 V to 2.7 V
0.7
V
voltage
VCC = 2.7 V to 3.6 V
0.8
VI
Input voltage
0
5.5
0
5.5
0
5.5
V
VO
Output voltage
0
VCC
0
VCC
0
VCC
V
VCC = 1.65 V
–4
VCC = 2.3 V
–8
High-level
IOH
mA
output current
VCC = 2.7 V
–12
VCC = 3 V
–24
VCC = 1.65 V
4
VCC = 2.3 V
8
Low-level output
IOL
mA
current
VCC = 2.7 V
12
VCC = 3 V
24
(1)
All unused inputs of the device must be held at VCC or GND to ensure proper device operation. Refer to the TI application report,
Implications of Slow or Floating CMOS Inputs, literature number SCBA004.
over recommended operating free-air temperature range (unless otherwise noted)
TA = 25°C
–40 TO 85
°C
–40 TO 125
°C
PAR-
TEST CONDITIONS
VCC
UNIT
AMETER
MIN
TYP
MAX
MIN
MAX
MIN
MAX
IOH = –100 A
1.65 V to 3.6 V
VCC – 0.2
VCC – 0.3
IOH = –4 mA
1.65 V
1.29
1.2
1.05
IOH = –8 mA
2.3 V
1.9
1.7
1.55
VOH
V
2.7 V
2.2
2.05
IOH = –12 mA
3 V
2.4
2.25
IOH = –24 mA
3 V
2.3
2.2
2
IOL = 100 A
1.65 V to 3.6 V
0.1
0.2
0.3
IOL = 4 mA
1.65 V
0.24
0.45
0.6
VOL
IOL = 8 mA
2.3 V
0.3
0.7
0.75
V
IOL = 12 mA
2.7 V
0.4
0.6
IOL = 24 mA
3 V
0.55
0.8
II
VI = 5.5 V or GND
3.6 V
±1
±5
±20
A
ICC
VI = VCC or GND,
IO = 0
3.6 V
1
10
40
A
One input at VCC – 0.6 V,
I
CC
Other inputs at VCC or
2.7 V to 3.6 V
500
5000
A
GND
Ci
VI = VCC or GND
3.3 V
5
pF
3
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PDF描述
SN74LVC10APWE4 LVC/LCX/Z SERIES, TRIPLE 3-INPUT NAND GATE, PDSO14
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SN74LVC10ADBR LVC/LCX/Z SERIES, TRIPLE 3-INPUT NAND GATE, PDSO14
SN74LVC112ADTE4 LVC/LCX/Z SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16
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參數(shù)描述
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