(VDD = 2.5 V ±10%, or 3" />
參數(shù)資料
型號： SI5351B-A-GT
廠商： Silicon Laboratories Inc
文件頁數(shù)： 45/72頁
文件大?。?/td> 0K
描述： IC CLK GEN PLL BLANK CUST 10MSOP
標準包裝： 50
系列： MultiSynth™
類型： *
PLL： 是
輸入： 晶體
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:8
差分 - 輸入:輸出： 無/無
頻率 - 最大： 133MHz
除法器/乘法器： 是/無
電源電壓： 2.25 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 10-TFSOP，10-MSOP（0.118"，3.00mm 寬）
供應商設備封裝： 10-MSOP
包裝： 管件
Si5351A/B/C
Preliminary Rev. 0.95
5
Table 3. AC Characteristics
(VDD = 2.5 V ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Power-up Time
TRDY
From VDD =VDDmin to valid
output clock, CL =5pF,
fCLKn >1MHz
—1
10
ms
Output Enable Time
TOE
From OEB pulled low to valid
clock output, CL =5pF,
fCLKn >1MHz
——
10
s
Output Phase Offset
PSTEP
—
333
—
ps/step
Spread Spectrum Frequency
Deviation
SSDEV
Down spread
–0.1
—
–2.5
%
Center spread
±0.1
—
±1.5
%
Spread Spectrum Modulation
Rate
SSMOD
30
31.5
33
kHz
VCXO Specifications (Si5351B only)
VCXO Control Voltage Range
Vc
0
VDD/2
VDD
V
VCXO Gain (configurable)
Kv
Vc = 10–90% of VDD, VDD = 3.3 V
18
—
150
ppm/V
VCXO Control Voltage Linearity
KVL
Vc = 10–90% of VDD
–5
—
+5
%
VCXO Pull Range
(configurable)
PR
VDD = 3.3 V*
±30
0
±240
ppm
VCXO Modulation Bandwidth
—
10
—
kHz
*Note: Contact Silicon Labs for 2.5 V VCXO operation.
Table 4. Input Clock Characteristics
(VDD = 2.5 V ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Units
CLKIN Input Low Voltage
VIL
–0.1
—
0.3 x VDD
V
CLKIN Input High Voltage
VIH
0.7 x VDD
—3.60
V
CLKIN Frequency Range
fCLKIN
10
—
100
MHz
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Si5351B-Axxxxx-GU 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Any-Rate, Dual PLL 133MHz Clock with VCXO and I2C, 8 outputs, 24-QSOP (customized) RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56
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