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參數資料
| 型號： | SI5351B-A-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數： | 60/72頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GEN PLL BLANK CUST 20-QFN |
| 標準包裝： | 75 |
| 系列： | MultiSynth™ |
| 類型： | * |
| PLL： | 是 |
| 輸入： | 晶體 |
| 輸出： | CMOS |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 1:8 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 133MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.25 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 20-QFN（4x4） |
| 包裝： | 管件 |
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Si5351A/B/C
Preliminary Rev. 0.95
63
10. Si5351B Pin Descriptions (20-Pin QFN, 24-Pin QSOP)
Table 11. Si5351B Pin Descriptions
Pin Name
Pin Number
Pin Type*
Function
20-QFN
24-QSOP
XA
1
6
I
Input pin for external crystal
XB
2
7
I
Input pin for external crystal
CLK0
13
21
O
Output clock 0
CLK1
12
20
O
Output clock 1
CLK2
9
15
O
Output clock 2
CLK3
8
14
O
Output clock 3
CLK4
19
3
O
Output clock 4
CLK5
17
1
O
Output clock 5
CLK6
16
24
O
Output clock 6
CLK7
15
23
O
Output clock 7
VC
3
9
I
VCXO control voltage input
SCL
4
10
I
I2C bus serial clock input. Pull-up to VDD core with 1 k
SDA
5
11
I/O
I2C bus serial data input. Pull-up to VDD core with 1 k
SSEN
6
12
I
Spread spectrum enable. High = enabled, Low = disabled.
OEB
7
13
I
Output driver enable. Low = enabled, High = disabled.
VDD
20
4
P
Core voltage supply pin
VDDOA
11
18
P
Output voltage supply pin for CLK0 and CLK1. See 6.2
VDDOB
10
16
P
Output voltage supply pin for CLK2 and CLK3. See 6.2
VDDOC
18
2
P
Output voltage supply pin for CLK4 and CLK5. See 6.2
VDDOD
14
22
P
Output voltage supply pin for CLK6 and CLK7. See 6.2
GND
Center Pad
5, 8, 17, 19
P
Ground
*Note: I = Input, O = Output, P = Power
*Note: Input pins are not internally pulled up.
1
2
3
4
5
6
7
8
9
10
15
14
13
12
11
20
19
18
17
16
XA
XB
VC
SCL
SDA
OEB
CL
K3
CL
K
2
VDD
O
B
SSE
N
Si5351B 20-QFN
Top View
GND
PAD
CLK6
CL
K
5
VD
DOC
CL
K
4
VD
D
VDDOA
CLK1
CLK0
VDDOD
CLK7
2
1
4
3
6
5
8
7
10
9
12
11
23
24
21
22
19
20
17
18
15
16
13
14
Si5351B 24-QSOP
Top View
VDDOC
CLK5
VDD
CLK4
XA
GND
XB
SCL
VC
SSEN
SDA
CLK7
CLK6
CLK0
VDD0D
GND
CLK1
GND
VDDOA
CLK2
VDD0B
OEB
CLK3
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PDF描述 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
| SI5351B-A-GMR | 功能描述:時鐘發(fā)生器及支持產品 Dual PLL 133MHz Clk VCXO and I2C 8 Outs RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| Si5351B-A-GT | 功能描述:時鐘發(fā)生器及支持產品 AnyRate 2 PLL 125MHz Clk w/VCXO&I2C 3out RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| Si5351B-A-GU | 功能描述:時鐘發(fā)生器及支持產品 AnyRate 2 PLL 125MHz Clk w/VCXO&I2C 8out RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| SI5351B-A-GUR | 功能描述:時鐘發(fā)生器及支持產品 Dual PLL 133MHz Clk VCXO and I2C 8 Outs RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| Si5351B-Axxxxx-GM | 功能描述:時鐘發(fā)生器及支持產品 Any-Rate, Dual PLL 133MHz Clock with VCXO and I2C, 8 outputs, 20-QFN (customized) RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
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