參數(shù)資料
型號(hào)： SI5350B-A-GT
廠(chǎng)商： Silicon Laboratories Inc
文件頁(yè)數(shù)： 24/24頁(yè)
文件大?。?/td> 0K
描述： IC CLK GEN PLL BLANK CUST 10MSOP
標(biāo)準(zhǔn)包裝： 50
系列： MultiSynth™
類(lèi)型： *
PLL： 是
輸入： 晶體
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:3
差分 - 輸入:輸出： 無(wú)/無(wú)
頻率 - 最大： 133MHz
除法器/乘法器： 是/無(wú)
電源電壓： 2.25 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 10-TFSOP，10-MSOP（0.118"，3.00mm 寬）
供應(yīng)商設(shè)備封裝： 10-MSOP
包裝： 管件
Si5350B
Rev. 0.9
9
2.3. HCSL Compatible Outputs
The Si5350B can be configured to support HCSL compatible swing when the VDDO of the output pair of interest is
set to 2.5 V (i.e., VDDOA must be 2.5 V when using CLK0/1; VDDOB must be 2.5 V for CLK2/3 and so on).
The circuit in the figure below must be applied to each of the two clocks used, and one of the clocks in the pair
must also be inverted to generate a differential pair.
Figure 3. Si5350B Output is HCSL Compatible
Multi
Synth
N
Multi
Synth
0
Multi
Synth
1
PLLB
PLLA
OSC
Note: The complementary -180 degree
out of phase output clock is generated
using the INV function
R1
511
240
R2
ZO = 70
0
HCSL
CLKIN
R1
511
240
R2
ZO = 70
0
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PDF描述
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