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參數(shù)資料
| 型號(hào)： | SI5110-G-BC |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 29/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX SERIAL/DESERIAL 99BGA |
| 標(biāo)準(zhǔn)包裝： | 176 |
| 系列： | SiPHY™ |
| 類型： | 收發(fā)器 |
| 驅(qū)動(dòng)器/接收器數(shù)： | 1/1 |
| 規(guī)程： | SONET/SDH |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 99-BCBGA |
| 供應(yīng)商設(shè)備封裝： | 99-CBGA（11x11） |
| 包裝： | 托盤 |
| 其它名稱： | 336-1181 |
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Si5110
Rev. 1.5
35
DOCUMENT CHANGE LIST
Revision 0.53 to Revision 1.0
Update Si5110 1. "Detailed Block Diagram" on page
4 to clarify control RXAMPMON and CMU timing
sources.
Figure 1 on page 5; clarified the measurement of
VICM, and VOCM
Updated Table 2 on page 6.
Updated Table 3 on page 8.
Updated Table 4 on page 9.
Updated Table 5 on page 9.
Updated Table 6 on page 10.
Updated Table 7 on page 11.
12 to show connection between FIFORSTb and
FIFOERRb.
Updated RXAMPMON description and equation in
Updated LOSLVL equations, and related figures
Clarified 5.3. "Clock and Data Recovery (CDR)" on
Updated RXAMPMON, RXDIN, REFCLK, and
TXCLK4IN pin descriptions in 17. "Pin Descriptions:
Revision 1.0 to Revision 1.1
Revision 1.1 to Revision 1.2
Updated LVDS Input Impedance in Table 2, “DC
Added test condition for Acquisition Time in Table 6,
Revision 1.2 to Revision 1.3
Updated chip graphic on page 1.
Corrected "18. Ordering Guide" on page 32.
Revision 1.3 to Revision 1.4
Updated "18. Ordering Guide" on page 32.
Updated "19. Package Outline" on page 33.
Revision 1.4 to Revision 1.5
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| Si5110-H-GL | 功能描述:電信線路管理 IC OC-48 STM-16 SONET SDH Trnscvr 1:16 RoHS:否 制造商:STMicroelectronics 產(chǎn)品:PHY 接口類型:UART 電源電壓-最大:18 V 電源電壓-最小:8 V 電源電流:30 mA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VFQFPN-48 封裝:Tray |
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