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參數(shù)資料
| 型號(hào)： | SDA9270 |
| 廠商： | SIEMENS A G |
| 元件分類(lèi)： | 消費(fèi)家電 |
| 英文描述： | ICs for Consumer Electronics |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP80 |
| 文件頁(yè)數(shù)： | 9/33頁(yè) |
| 文件大?。?/td> | 596K |
| 代理商： | SDA9270 |
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SDA 9270
Semiconductor Group
9
2.1
The SDA 9270 accepts for the input channels A and B two different input formats
(
I
2
C-Bus : INFOR) with two possible sample frequency relations of Y : (B-Y) : (R-Y). The
representation of the samples is programmable separately for luminance and
chrominance signals as positive dual code or 2’s complement code (
I
2
C-Bus : INCODL,
INCODC)
Input Data Format
X
ab
:
The amplitude resolution for each input signal component is 8 bit, the maximum clock
frequency is 30 MHz. Consequently the SDA 9270 is dedicated for applications in high
quality digital video systems. The data input stages and the internal data multiplexer
operate with a special input clock (SCA). For applications in the Siemens MEGAVISION
System the SCA-clock is identical with the memory output clock.
X: signal component
a: sample number
b: bit number
Data
Pin
Yx7
Yx6
Yx5
Yx4
Yx3
Yx2
Yx1
Yx0
UVx7
UVx6
UVx5
UVx4
UVx3
UVx2
UVx1
UVx0
Data Format 4:1:1
INFOR = 0
Y
17
Y
16
Y
15
Y
14
Y
13
Y
12
Y
11
Y
10
U
05
U
04
V
05
V
04
4:2:2 Parallel
INFOR = 1
Y
07
Y
06
Y
05
Y
04
Y
03
Y
02
Y
01
Y
00
U
07
U
06
U
05
U
04
U
03
U
02
U
01
U
00
Y
07
Y
06
Y
05
Y
04
Y
03
Y
02
Y
01
Y
00
U
07
U
06
V
07
V
06
Y
27
Y
26
Y
25
Y
24
Y
23
Y
22
Y
21
Y
20
U
03
U
02
V
03
V
02
Y
37
Y
36
Y
35
Y
34
Y
33
Y
32
Y
31
Y
30
U
01
U
00
V
01
V
00
Y
17
Y
16
Y
15
Y
14
Y
13
Y
12
Y
11
Y
10
V
07
V
06
V
05
V
04
V
03
V
02
V
01
V
00
Yx,UVx :
x : A,B
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SDA9290-6 | Picture Processor |
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| SDR3005MTXV | 30A 80nsec 400 to 600 V Ultrafast Rectifier |
| SDR3005ZS | 30A 80nsec 400 to 600 V Ultrafast Rectifier |
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參數(shù)描述 |
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