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參數(shù)資料
| 型號： | SDA9255 |
| 廠商： | SIEMENS AG |
| 英文描述： | SRC-Scan Rate Converter SDA9255 |
| 中文描述： | 鋼骨混凝土掃描頻率轉(zhuǎn)換器SDA9255 |
| 文件頁數(shù)： | 9/45頁 |
| 文件大?。?/td> | 225K |
| 代理商： | SDA9255 |
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SDA 9255
Semiconductor Group
7
1998-02-01
1.4
Pin Description
S: supply,
I: input,
O: output,
TTL: digital (TTL)
Pin No.
2,8,24,26,41,55,
57
9,25,40,56
42,...,49
36,...,39
30
31
Name
V
SS
Type
S
Description
Supply voltage (
V
SS
= 0 V)
V
DD
YIN0 ... 7
UVIN4 ... 7
SYNCEN
RESET
S
I/TTL
I/TTL
I/TTL
I/TTL
Supply voltage (
V
DD
= 5 V)
Data input Y (
see data format
)
Data input UV (
see data format
)
Synchronization enable input
System reset. The RESET input is low active.
In order to ensure correct operation a
"
Power
On Reset
"
must be performed. The RESET
pulse must have a minimum duration of two
clock periods of the system clock (LL2CLK).
H-Sync input
V-Sync input
I
2
C-Bus data line
I
2
C-Bus clock line
Test input, connect to
V
SS
for normal operation
Test enable input, connect to
V
SS
for normal
operation
O/TTL Data output UV (
see data format
)
O/TTL Data output Y (
see data format
)
O/TTL Horizontal active video output
O/TTL V-Sync output
O/TTL H-Sync output
INTERLACED O/TTL Interlace signal for AC coupled vertical
deflection
LL2CLK
I/TTL
System clock
TEST
I/TTL
Test input, connect to
V
SS
for normal operation
TESTO 4...9
O
Do not connect, Pins have to be left open
23
22
21
20
19
18
HIN
VIN
SDA
SCL
TESTIN
TESTEN
I/TTL
I/TTL
I/O
I
I/TTL
I/TTL
13,...,10
7,...,3,1,64,63
62
61
60
59
UVOUT4 ... 7
YOUT0 ... 7
HREF
VOUT
HOUT
58,51
50
27,28,29,
52,53,54
14,15,16,17
TESTO 0...3
O
Not used output stages, do not connect to any
other driver,
V
SS
or
V
DD
; Pins can be left open
Input stages (internal pull-down); Pins can be
left open
32,33,34,35
TESTI 0...3
I
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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