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參數(shù)資料
| 型號： | SC1200UFH-266F |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA481 |
| 封裝： | LEAD FREE, MS-034BAU1, TEPBGA-481 |
| 文件頁數(shù)： | 318/443頁 |
| 文件大小： | 3498K |
| 代理商： | SC1200UFH-266F |
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AMD Geode SC1200/SC1201 Processor Data Book
385
Electrical Specifications
32579B
9.3.5
ACCESS.bus Interface
The following tables describe the timing for the ACCESS.bus signals.
Notes: 1) All ACCESS.bus timing is not 100% tested.
2) In this table tCLK = 1/24MHz = 41.7 ns.
Table 9-18. ACCESS.bus Input Timing Parameters
Symbol
Parameter
Min
Max
Unit
Comments
tBUFi
Bus free time between
Stop and Start condition
tSCLhigho
tCSTOsi
AB1C/AB2C setup time
8 * tCLK - tSCLri
Before Stop condition
tCSTRhi
AB1C/AB2C hold time
8 * tCLK - tSCLri
After Start condition
tCSTRsi
AB1C/AB2C setup time
8 * tCLK - tSCLri
Before Start condition
tDHCsi
Data high setup time
2 * tCLK
Before AB1C/AB2C rising edge
tDLCsi
Data low setup time
2 * tCLK
Before AB1C/AB2C rising edge
tSCLfi
AB1D/AB2D fall time
300
ns
tSCLri
AB1D/AB2D rise time
1
μs
tSCLlowi
AB1C/AB2C low time
16 * tCLK
After AB1C/AB2C falling edge
tSCLhighi
AB1C/AB2C high time
16 * tCLK
After AB1C/AB2C rising edge
tSDAfi
AB1D/AB2D fall time
300
ns
tSDAri
AB1D/AB2D rise time
1
μs
tSDAhi
AB1D/AB2D hold time
0
After AB1C/AB2C falling edge
tSDAsi
AB1D/AB2D setup time
2 * tCLK
Before AB1C/AB2C rising edge
Table 9-19. ACCESS.bus Output Timing Parameters
Symbol
Parameter
Min
Max
Unit
Comments
tSCLhigho
AB1C/AB2C high time
K * tCLK - 1 μs
After AB1C/AB2C rising edge,
Note 1
tSCLlowo
AB1C/AB2C low time
K * tCLK - 1 μs
After AB1C/AB2C falling edge
tBUFo
Bus free time between
Stop and Start condition
tSCLhigho
1
μs
Note 2
tCSTOso
AB1C/AB2C setup time
tSCLhigho
1
μs
Before Stop condition, Note 2
tCSTRho
AB1C/AB2C hold time
tSCLhigho
1
μs
After Start condition, Note 2
tCSTRso
AB1C/AB2C setup time
tSCLhigho
1
μs
Before Start condition, Note 2
tDHCso
Data high setup time
tSCLhigho - tSDAro
1
μs
Before AB1C/AB2C rising
edge, Note 2
tDLCso
Data low setup time
tSCLhigho - tSDAfo
1
μs
Before AB1C/AB2C rising
edge, Note 2
tSCLfo
AB1D/AB2D signal fall
time
300
ns
tSCLro
AB1D/AB2D signal rise
time
1
μs
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SC1201UFH-266 | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA481 |
| SC1201UCL-266 | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432 |
| SC1201UCL-266F | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432 |
| SC12484CV-80 | PALETTE-DAC DSPL CTLR, PQCC44 |
| SC11483CV-110 | PALETTE-DAC DSPL CTLR, PQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SC1200UFH-266F 33 | 制造商:Advanced Micro Devices 功能描述:GEO IC OPN |
| SC1200W WAF | 制造商:Texas Instruments 功能描述: |
| SC-1200WT | 制造商:Dantona Industries 功能描述: |
| SC1200WWD3 WAF | 制造商:Advanced Micro Devices 功能描述: |
| SC1201UCL-266 D3 | 制造商:Advanced Micro Devices 功能描述: |
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