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參數(shù)資料
| 型號： | CY39165V676-125MBC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | LOADABLE PLD, 10 ns, PBGA676 |
| 封裝： | 27 X 27 MM, 1.6 MM HEIGHT, 1 MM PITCH, FBGA-676 |
| 文件頁數(shù)： | 32/86頁 |
| 文件大?。?/td> | 1212K |
| 代理商： | CY39165V676-125MBC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 32 of 86
Switching Waveforms
(continued)
Channel Memory DP SRAM Pipeline R/W Timing
A
n+1
A
n+2
D
n+1
t
CHMCYC2
t
CHMH
t
CHMS
t
CHMS
t
CHMH
A
n
t
CHMS
t
CHMH
A
n+3
A
n–1
D
n+3
D
n–1
D
n–1
t
CHMDV2
t
CHMDV2
D
n
D
n+1
D
n+2
t
CHMDV2
CLOCK
WRITE
ENABLE
OUTPUT
ADDRESS
DATA
INPUT
Dual-Port Asynchronous Address Match Busy Signal
ADDRESS A
A
n
A
n–1
A
n
A
n+1
ADDRESS
MATCH
t
CHMBA
t
CHMBA
B
n
ADDRESS B
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY39165V676-125MBI | CPLDs at FPGA Densities |
| CY39165V676-125MGC | CPLDs at FPGA Densities |
| CY39165V676-125MGI | CPLDs at FPGA Densities |
| CY39165V676-125NC | CPLDs at FPGA Densities |
| CY39165V676-125NI | CPLDs at FPGA Densities |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39165V676-125MBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39165V676-125MGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39165V676-125MGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39165V676-125NC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39165V676-125NI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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