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參數(shù)資料
| 型號： | SAB82532N-10 |
| 廠商： | SIEMENS A G |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | ICs for Communications |
| 中文描述： | 2 CHANNEL(S), 10M bps, SERIAL COMM CONTROLLER, PQCC68 |
| 文件頁數(shù)： | 202/272頁 |
| 文件大?。?/td> | 4055K |
| 代理商： | SAB82532N-10 |
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SAB 82532/SAF 82532
BISYNC Mode
Detailed Register Description
Semiconductor Group
202
07.96
Interrupt Controlled Data Transfer (interrupt mode)
Selected if DMA bit in XBCH is set to ‘0’.
Up to 32 bytes/16 words of received data can be read from the RFIFO following a RPF
or a TCD interrupt depending on the selected RFIFO mode (refer to RFC register):
RPF interrupt: A fixed number of bytes/words (programmed threshold level RFTH0, 1)
has to be read by the CPU.
TCD interrupt: Termination character detected. The received data stream is monitored
for a ‘termination character’ (programmable via register TCR). The number of valid bytes
in RFIFO is determined by reading the RBCL register.
If necessary, the CPU can have access to RFIFO by issuing RFIFO Read command
(CMDR.RFRD) before threshold level or termination character condition is reached. The
number of valid
bytes
is determined by reading the RBCL register. Additional
information: STAR:RFNE: RFIFO Not Empty.
DMA Controlled Data Transfer (DMA mode)
Selected if DMA bit in XBCH is set.
If the RFIFO contains the number of bytes/words defined by the threshold level, the
ESCC2 autonomously requests a block data transfer by DMA by activating the DRRn
line until the last valid data is read (the DRRn line remains active up to the beginning of
the last read cycle).
This forces the DMA controller to continuously perform bus cycles till all data is
transferred from the ESCC2 to the system memory (level triggered transfer mode of
DMA controller). If the end condition (TCD) is reached, the same procedure as above is
performed. DRRn is activated until the termination character is transferred, at which time
a TCD interrupt is generated. Generation of further DMA requests is blocked until TCD
interrupt has been acknowledged by issuing an RMC command. The valid
byte
count of
the last block can determined by reading the RBCL register following the TCD interrupt.
Note: Addresses within the 32-byte address space of the FIFO point all to the same
byte/word, i.e. current data can be accessed with any address within the valid
range.
相關PDF資料 |
PDF描述 |
|---|---|
| SAF82532 | ICs for Communications |
| SAF82532N-10 | ICs for Communications |
| SAB82532H-10 | ICs for Communications |
| SAFC161U | Embedded C166 with USB, USART and SSC |
| SAFC163-L | Circular Connector; No. of Contacts:37; Series:MS27467; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:15; Circular Contact Gender:Pin; Circular Shell Style:Straight Plug; Insert Arrangement:15-35 RoHS Compliant: No |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SAB82532N10V2.2 | 制造商:Infineon Technologies AG 功能描述: |
| SAB82532N-10V2.2 | 制造商:Siemens 功能描述:2 CHANNEL(S), 10M BPS, MULTI PROTOCOL CONTROLLER, PQCC68 |
| SAB82532N-10V3.2A | 制造商:Siemens 功能描述:Part Number Only |
| SAB82532N10V3.3 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SAB82532N10V32A | 制造商:Infineon Technologies AG 功能描述:Communication Controller 68-Pin PLCC |
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